| 1 | /* |
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| 2 | * Copyright 2013 Advanced Micro Devices, Inc. |
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| 3 | * |
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| 4 | * Permission is hereby granted, free of charge, to any person obtaining a |
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| 5 | * copy of this software and associated documentation files (the "Software"), |
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| 19 | * ARISING FROM, OUT OF OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR |
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| 20 | * OTHER DEALINGS IN THE SOFTWARE. |
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| 21 | * |
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| 22 | */ |
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| 23 | |
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| 24 | #include "clearstate_defs.h" |
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| 25 | |
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| 26 | static const u32 si_SECT_CONTEXT_def_1[] = { |
|---|
| 27 | 0x00000000, // DB_RENDER_CONTROL |
|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 166 | 0x40004000, // PA_SC_CLIPRECT_3_BR |
|---|
| 167 | 0xaa99aaaa, // PA_SC_EDGERULE |
|---|
| 168 | 0x00000000, // PA_SU_HARDWARE_SCREEN_OFFSET |
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|---|
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|---|
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|---|
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|---|
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|---|
| 178 | 0x40004000, // PA_SC_VPORT_SCISSOR_1_BR |
|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 195 | 0x80000000, // PA_SC_VPORT_SCISSOR_10_TL |
|---|
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|---|
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|---|
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|---|
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|---|
| 200 | 0x40004000, // PA_SC_VPORT_SCISSOR_12_BR |
|---|
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|---|
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|---|
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|---|
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|---|
| 205 | 0x80000000, // PA_SC_VPORT_SCISSOR_15_TL |
|---|
| 206 | 0x40004000, // PA_SC_VPORT_SCISSOR_15_BR |
|---|
| 207 | 0x00000000, // PA_SC_VPORT_ZMIN_0 |
|---|
| 208 | 0x3f800000, // PA_SC_VPORT_ZMAX_0 |
|---|
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|---|
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|---|
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|---|
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|---|
| 213 | 0x00000000, // PA_SC_VPORT_ZMIN_3 |
|---|
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|---|
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|---|
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|---|
| 217 | 0x00000000, // PA_SC_VPORT_ZMIN_5 |
|---|
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|---|
| 219 | 0x00000000, // PA_SC_VPORT_ZMIN_6 |
|---|
| 220 | 0x3f800000, // PA_SC_VPORT_ZMAX_6 |
|---|
| 221 | 0x00000000, // PA_SC_VPORT_ZMIN_7 |
|---|
| 222 | 0x3f800000, // PA_SC_VPORT_ZMAX_7 |
|---|
| 223 | 0x00000000, // PA_SC_VPORT_ZMIN_8 |
|---|
| 224 | 0x3f800000, // PA_SC_VPORT_ZMAX_8 |
|---|
| 225 | 0x00000000, // PA_SC_VPORT_ZMIN_9 |
|---|
| 226 | 0x3f800000, // PA_SC_VPORT_ZMAX_9 |
|---|
| 227 | 0x00000000, // PA_SC_VPORT_ZMIN_10 |
|---|
| 228 | 0x3f800000, // PA_SC_VPORT_ZMAX_10 |
|---|
| 229 | 0x00000000, // PA_SC_VPORT_ZMIN_11 |
|---|
| 230 | 0x3f800000, // PA_SC_VPORT_ZMAX_11 |
|---|
| 231 | 0x00000000, // PA_SC_VPORT_ZMIN_12 |
|---|
| 232 | 0x3f800000, // PA_SC_VPORT_ZMAX_12 |
|---|
| 233 | 0x00000000, // PA_SC_VPORT_ZMIN_13 |
|---|
| 234 | 0x3f800000, // PA_SC_VPORT_ZMAX_13 |
|---|
| 235 | 0x00000000, // PA_SC_VPORT_ZMIN_14 |
|---|
| 236 | 0x3f800000, // PA_SC_VPORT_ZMAX_14 |
|---|
| 237 | 0x00000000, // PA_SC_VPORT_ZMIN_15 |
|---|
| 238 | 0x3f800000, // PA_SC_VPORT_ZMAX_15 |
|---|
| 239 | }; |
|---|
| 240 | static const u32 si_SECT_CONTEXT_def_2[] = |
|---|
| 241 | { |
|---|
| 242 | 0x00000000, // CP_PERFMON_CNTX_CNTL |
|---|
| 243 | 0x00000000, // CP_RINGID |
|---|
| 244 | 0x00000000, // CP_VMID |
|---|
| 245 | 0, // HOLE |
|---|
| 246 | 0, // HOLE |
|---|
| 247 | 0, // HOLE |
|---|
| 248 | 0, // HOLE |
|---|
| 249 | 0, // HOLE |
|---|
| 250 | 0, // HOLE |
|---|
| 251 | 0, // HOLE |
|---|
| 252 | 0, // HOLE |
|---|
| 253 | 0, // HOLE |
|---|
| 254 | 0, // HOLE |
|---|
| 255 | 0, // HOLE |
|---|
| 256 | 0, // HOLE |
|---|
| 257 | 0, // HOLE |
|---|
| 258 | 0, // HOLE |
|---|
| 259 | 0, // HOLE |
|---|
| 260 | 0, // HOLE |
|---|
| 261 | 0, // HOLE |
|---|
| 262 | 0, // HOLE |
|---|
| 263 | 0, // HOLE |
|---|
| 264 | 0, // HOLE |
|---|
| 265 | 0, // HOLE |
|---|
| 266 | 0, // HOLE |
|---|
| 267 | 0, // HOLE |
|---|
| 268 | 0, // HOLE |
|---|
| 269 | 0, // HOLE |
|---|
| 270 | 0, // HOLE |
|---|
| 271 | 0, // HOLE |
|---|
| 272 | 0, // HOLE |
|---|
| 273 | 0, // HOLE |
|---|
| 274 | 0, // HOLE |
|---|
| 275 | 0, // HOLE |
|---|
| 276 | 0, // HOLE |
|---|
| 277 | 0, // HOLE |
|---|
| 278 | 0, // HOLE |
|---|
| 279 | 0, // HOLE |
|---|
| 280 | 0, // HOLE |
|---|
| 281 | 0, // HOLE |
|---|
| 282 | 0xffffffff, // VGT_MAX_VTX_INDX |
|---|
| 283 | 0x00000000, // VGT_MIN_VTX_INDX |
|---|
| 284 | 0x00000000, // VGT_INDX_OFFSET |
|---|
| 285 | 0x00000000, // VGT_MULTI_PRIM_IB_RESET_INDX |
|---|
| 286 | 0, // HOLE |
|---|
| 287 | 0x00000000, // CB_BLEND_RED |
|---|
| 288 | 0x00000000, // CB_BLEND_GREEN |
|---|
| 289 | 0x00000000, // CB_BLEND_BLUE |
|---|
| 290 | 0x00000000, // CB_BLEND_ALPHA |
|---|
| 291 | 0, // HOLE |
|---|
| 292 | 0, // HOLE |
|---|
| 293 | 0x00000000, // DB_STENCIL_CONTROL |
|---|
| 294 | 0x00000000, // DB_STENCILREFMASK |
|---|
| 295 | 0x00000000, // DB_STENCILREFMASK_BF |
|---|
| 296 | 0, // HOLE |
|---|
| 297 | 0x00000000, // PA_CL_VPORT_XSCALE |
|---|
| 298 | 0x00000000, // PA_CL_VPORT_XOFFSET |
|---|
| 299 | 0x00000000, // PA_CL_VPORT_YSCALE |
|---|
| 300 | 0x00000000, // PA_CL_VPORT_YOFFSET |
|---|
| 301 | 0x00000000, // PA_CL_VPORT_ZSCALE |
|---|
| 302 | 0x00000000, // PA_CL_VPORT_ZOFFSET |
|---|
| 303 | 0x00000000, // PA_CL_VPORT_XSCALE_1 |
|---|
| 304 | 0x00000000, // PA_CL_VPORT_XOFFSET_1 |
|---|
| 305 | 0x00000000, // PA_CL_VPORT_YSCALE_1 |
|---|
| 306 | 0x00000000, // PA_CL_VPORT_YOFFSET_1 |
|---|
| 307 | 0x00000000, // PA_CL_VPORT_ZSCALE_1 |
|---|
| 308 | 0x00000000, // PA_CL_VPORT_ZOFFSET_1 |
|---|
| 309 | 0x00000000, // PA_CL_VPORT_XSCALE_2 |
|---|
| 310 | 0x00000000, // PA_CL_VPORT_XOFFSET_2 |
|---|
| 311 | 0x00000000, // PA_CL_VPORT_YSCALE_2 |
|---|
| 312 | 0x00000000, // PA_CL_VPORT_YOFFSET_2 |
|---|
| 313 | 0x00000000, // PA_CL_VPORT_ZSCALE_2 |
|---|
| 314 | 0x00000000, // PA_CL_VPORT_ZOFFSET_2 |
|---|
| 315 | 0x00000000, // PA_CL_VPORT_XSCALE_3 |
|---|
| 316 | 0x00000000, // PA_CL_VPORT_XOFFSET_3 |
|---|
| 317 | 0x00000000, // PA_CL_VPORT_YSCALE_3 |
|---|
| 318 | 0x00000000, // PA_CL_VPORT_YOFFSET_3 |
|---|
| 319 | 0x00000000, // PA_CL_VPORT_ZSCALE_3 |
|---|
| 320 | 0x00000000, // PA_CL_VPORT_ZOFFSET_3 |
|---|
| 321 | 0x00000000, // PA_CL_VPORT_XSCALE_4 |
|---|
| 322 | 0x00000000, // PA_CL_VPORT_XOFFSET_4 |
|---|
| 323 | 0x00000000, // PA_CL_VPORT_YSCALE_4 |
|---|
| 324 | 0x00000000, // PA_CL_VPORT_YOFFSET_4 |
|---|
| 325 | 0x00000000, // PA_CL_VPORT_ZSCALE_4 |
|---|
| 326 | 0x00000000, // PA_CL_VPORT_ZOFFSET_4 |
|---|
| 327 | 0x00000000, // PA_CL_VPORT_XSCALE_5 |
|---|
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|---|
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|---|
| 330 | 0x00000000, // PA_CL_VPORT_YOFFSET_5 |
|---|
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|---|
| 332 | 0x00000000, // PA_CL_VPORT_ZOFFSET_5 |
|---|
| 333 | 0x00000000, // PA_CL_VPORT_XSCALE_6 |
|---|
| 334 | 0x00000000, // PA_CL_VPORT_XOFFSET_6 |
|---|
| 335 | 0x00000000, // PA_CL_VPORT_YSCALE_6 |
|---|
| 336 | 0x00000000, // PA_CL_VPORT_YOFFSET_6 |
|---|
| 337 | 0x00000000, // PA_CL_VPORT_ZSCALE_6 |
|---|
| 338 | 0x00000000, // PA_CL_VPORT_ZOFFSET_6 |
|---|
| 339 | 0x00000000, // PA_CL_VPORT_XSCALE_7 |
|---|
| 340 | 0x00000000, // PA_CL_VPORT_XOFFSET_7 |
|---|
| 341 | 0x00000000, // PA_CL_VPORT_YSCALE_7 |
|---|
| 342 | 0x00000000, // PA_CL_VPORT_YOFFSET_7 |
|---|
| 343 | 0x00000000, // PA_CL_VPORT_ZSCALE_7 |
|---|
| 344 | 0x00000000, // PA_CL_VPORT_ZOFFSET_7 |
|---|
| 345 | 0x00000000, // PA_CL_VPORT_XSCALE_8 |
|---|
| 346 | 0x00000000, // PA_CL_VPORT_XOFFSET_8 |
|---|
| 347 | 0x00000000, // PA_CL_VPORT_YSCALE_8 |
|---|
| 348 | 0x00000000, // PA_CL_VPORT_YOFFSET_8 |
|---|
| 349 | 0x00000000, // PA_CL_VPORT_ZSCALE_8 |
|---|
| 350 | 0x00000000, // PA_CL_VPORT_ZOFFSET_8 |
|---|
| 351 | 0x00000000, // PA_CL_VPORT_XSCALE_9 |
|---|
| 352 | 0x00000000, // PA_CL_VPORT_XOFFSET_9 |
|---|
| 353 | 0x00000000, // PA_CL_VPORT_YSCALE_9 |
|---|
| 354 | 0x00000000, // PA_CL_VPORT_YOFFSET_9 |
|---|
| 355 | 0x00000000, // PA_CL_VPORT_ZSCALE_9 |
|---|
| 356 | 0x00000000, // PA_CL_VPORT_ZOFFSET_9 |
|---|
| 357 | 0x00000000, // PA_CL_VPORT_XSCALE_10 |
|---|
| 358 | 0x00000000, // PA_CL_VPORT_XOFFSET_10 |
|---|
| 359 | 0x00000000, // PA_CL_VPORT_YSCALE_10 |
|---|
| 360 | 0x00000000, // PA_CL_VPORT_YOFFSET_10 |
|---|
| 361 | 0x00000000, // PA_CL_VPORT_ZSCALE_10 |
|---|
| 362 | 0x00000000, // PA_CL_VPORT_ZOFFSET_10 |
|---|
| 363 | 0x00000000, // PA_CL_VPORT_XSCALE_11 |
|---|
| 364 | 0x00000000, // PA_CL_VPORT_XOFFSET_11 |
|---|
| 365 | 0x00000000, // PA_CL_VPORT_YSCALE_11 |
|---|
| 366 | 0x00000000, // PA_CL_VPORT_YOFFSET_11 |
|---|
| 367 | 0x00000000, // PA_CL_VPORT_ZSCALE_11 |
|---|
| 368 | 0x00000000, // PA_CL_VPORT_ZOFFSET_11 |
|---|
| 369 | 0x00000000, // PA_CL_VPORT_XSCALE_12 |
|---|
| 370 | 0x00000000, // PA_CL_VPORT_XOFFSET_12 |
|---|
| 371 | 0x00000000, // PA_CL_VPORT_YSCALE_12 |
|---|
| 372 | 0x00000000, // PA_CL_VPORT_YOFFSET_12 |
|---|
| 373 | 0x00000000, // PA_CL_VPORT_ZSCALE_12 |
|---|
| 374 | 0x00000000, // PA_CL_VPORT_ZOFFSET_12 |
|---|
| 375 | 0x00000000, // PA_CL_VPORT_XSCALE_13 |
|---|
| 376 | 0x00000000, // PA_CL_VPORT_XOFFSET_13 |
|---|
| 377 | 0x00000000, // PA_CL_VPORT_YSCALE_13 |
|---|
| 378 | 0x00000000, // PA_CL_VPORT_YOFFSET_13 |
|---|
| 379 | 0x00000000, // PA_CL_VPORT_ZSCALE_13 |
|---|
| 380 | 0x00000000, // PA_CL_VPORT_ZOFFSET_13 |
|---|
| 381 | 0x00000000, // PA_CL_VPORT_XSCALE_14 |
|---|
| 382 | 0x00000000, // PA_CL_VPORT_XOFFSET_14 |
|---|
| 383 | 0x00000000, // PA_CL_VPORT_YSCALE_14 |
|---|
| 384 | 0x00000000, // PA_CL_VPORT_YOFFSET_14 |
|---|
| 385 | 0x00000000, // PA_CL_VPORT_ZSCALE_14 |
|---|
| 386 | 0x00000000, // PA_CL_VPORT_ZOFFSET_14 |
|---|
| 387 | 0x00000000, // PA_CL_VPORT_XSCALE_15 |
|---|
| 388 | 0x00000000, // PA_CL_VPORT_XOFFSET_15 |
|---|
| 389 | 0x00000000, // PA_CL_VPORT_YSCALE_15 |
|---|
| 390 | 0x00000000, // PA_CL_VPORT_YOFFSET_15 |
|---|
| 391 | 0x00000000, // PA_CL_VPORT_ZSCALE_15 |
|---|
| 392 | 0x00000000, // PA_CL_VPORT_ZOFFSET_15 |
|---|
| 393 | 0x00000000, // PA_CL_UCP_0_X |
|---|
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|---|
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|---|
| 396 | 0x00000000, // PA_CL_UCP_0_W |
|---|
| 397 | 0x00000000, // PA_CL_UCP_1_X |
|---|
| 398 | 0x00000000, // PA_CL_UCP_1_Y |
|---|
| 399 | 0x00000000, // PA_CL_UCP_1_Z |
|---|
| 400 | 0x00000000, // PA_CL_UCP_1_W |
|---|
| 401 | 0x00000000, // PA_CL_UCP_2_X |
|---|
| 402 | 0x00000000, // PA_CL_UCP_2_Y |
|---|
| 403 | 0x00000000, // PA_CL_UCP_2_Z |
|---|
| 404 | 0x00000000, // PA_CL_UCP_2_W |
|---|
| 405 | 0x00000000, // PA_CL_UCP_3_X |
|---|
| 406 | 0x00000000, // PA_CL_UCP_3_Y |
|---|
| 407 | 0x00000000, // PA_CL_UCP_3_Z |
|---|
| 408 | 0x00000000, // PA_CL_UCP_3_W |
|---|
| 409 | 0x00000000, // PA_CL_UCP_4_X |
|---|
| 410 | 0x00000000, // PA_CL_UCP_4_Y |
|---|
| 411 | 0x00000000, // PA_CL_UCP_4_Z |
|---|
| 412 | 0x00000000, // PA_CL_UCP_4_W |
|---|
| 413 | 0x00000000, // PA_CL_UCP_5_X |
|---|
| 414 | 0x00000000, // PA_CL_UCP_5_Y |
|---|
| 415 | 0x00000000, // PA_CL_UCP_5_Z |
|---|
| 416 | 0x00000000, // PA_CL_UCP_5_W |
|---|
| 417 | 0, // HOLE |
|---|
| 418 | 0, // HOLE |
|---|
| 419 | 0, // HOLE |
|---|
| 420 | 0, // HOLE |
|---|
| 421 | 0, // HOLE |
|---|
| 422 | 0, // HOLE |
|---|
| 423 | 0, // HOLE |
|---|
| 424 | 0, // HOLE |
|---|
| 425 | 0, // HOLE |
|---|
| 426 | 0, // HOLE |
|---|
| 427 | 0x00000000, // SPI_PS_INPUT_CNTL_0 |
|---|
| 428 | 0x00000000, // SPI_PS_INPUT_CNTL_1 |
|---|
| 429 | 0x00000000, // SPI_PS_INPUT_CNTL_2 |
|---|
| 430 | 0x00000000, // SPI_PS_INPUT_CNTL_3 |
|---|
| 431 | 0x00000000, // SPI_PS_INPUT_CNTL_4 |
|---|
| 432 | 0x00000000, // SPI_PS_INPUT_CNTL_5 |
|---|
| 433 | 0x00000000, // SPI_PS_INPUT_CNTL_6 |
|---|
| 434 | 0x00000000, // SPI_PS_INPUT_CNTL_7 |
|---|
| 435 | 0x00000000, // SPI_PS_INPUT_CNTL_8 |
|---|
| 436 | 0x00000000, // SPI_PS_INPUT_CNTL_9 |
|---|
| 437 | 0x00000000, // SPI_PS_INPUT_CNTL_10 |
|---|
| 438 | 0x00000000, // SPI_PS_INPUT_CNTL_11 |
|---|
| 439 | 0x00000000, // SPI_PS_INPUT_CNTL_12 |
|---|
| 440 | 0x00000000, // SPI_PS_INPUT_CNTL_13 |
|---|
| 441 | 0x00000000, // SPI_PS_INPUT_CNTL_14 |
|---|
| 442 | 0x00000000, // SPI_PS_INPUT_CNTL_15 |
|---|
| 443 | 0x00000000, // SPI_PS_INPUT_CNTL_16 |
|---|
| 444 | 0x00000000, // SPI_PS_INPUT_CNTL_17 |
|---|
| 445 | 0x00000000, // SPI_PS_INPUT_CNTL_18 |
|---|
| 446 | 0x00000000, // SPI_PS_INPUT_CNTL_19 |
|---|
| 447 | 0x00000000, // SPI_PS_INPUT_CNTL_20 |
|---|
| 448 | 0x00000000, // SPI_PS_INPUT_CNTL_21 |
|---|
| 449 | 0x00000000, // SPI_PS_INPUT_CNTL_22 |
|---|
| 450 | 0x00000000, // SPI_PS_INPUT_CNTL_23 |
|---|
| 451 | 0x00000000, // SPI_PS_INPUT_CNTL_24 |
|---|
| 452 | 0x00000000, // SPI_PS_INPUT_CNTL_25 |
|---|
| 453 | 0x00000000, // SPI_PS_INPUT_CNTL_26 |
|---|
| 454 | 0x00000000, // SPI_PS_INPUT_CNTL_27 |
|---|
| 455 | 0x00000000, // SPI_PS_INPUT_CNTL_28 |
|---|
| 456 | 0x00000000, // SPI_PS_INPUT_CNTL_29 |
|---|
| 457 | 0x00000000, // SPI_PS_INPUT_CNTL_30 |
|---|
| 458 | 0x00000000, // SPI_PS_INPUT_CNTL_31 |
|---|
| 459 | 0x00000000, // SPI_VS_OUT_CONFIG |
|---|
| 460 | 0, // HOLE |
|---|
| 461 | 0x00000000, // SPI_PS_INPUT_ENA |
|---|
| 462 | 0x00000000, // SPI_PS_INPUT_ADDR |
|---|
| 463 | 0x00000000, // SPI_INTERP_CONTROL_0 |
|---|
| 464 | 0x00000002, // SPI_PS_IN_CONTROL |
|---|
| 465 | 0, // HOLE |
|---|
| 466 | 0x00000000, // SPI_BARYC_CNTL |
|---|
| 467 | 0, // HOLE |
|---|
| 468 | 0x00000000, // SPI_TMPRING_SIZE |
|---|
| 469 | 0, // HOLE |
|---|
| 470 | 0, // HOLE |
|---|
| 471 | 0, // HOLE |
|---|
| 472 | 0, // HOLE |
|---|
| 473 | 0, // HOLE |
|---|
| 474 | 0, // HOLE |
|---|
| 475 | 0x00000000, // SPI_WAVE_MGMT_1 |
|---|
| 476 | 0x00000000, // SPI_WAVE_MGMT_2 |
|---|
| 477 | 0x00000000, // SPI_SHADER_POS_FORMAT |
|---|
| 478 | 0x00000000, // SPI_SHADER_Z_FORMAT |
|---|
| 479 | 0x00000000, // SPI_SHADER_COL_FORMAT |
|---|
| 480 | 0, // HOLE |
|---|
| 481 | 0, // HOLE |
|---|
| 482 | 0, // HOLE |
|---|
| 483 | 0, // HOLE |
|---|
| 484 | 0, // HOLE |
|---|
| 485 | 0, // HOLE |
|---|
| 486 | 0, // HOLE |
|---|
| 487 | 0, // HOLE |
|---|
| 488 | 0, // HOLE |
|---|
| 489 | 0, // HOLE |
|---|
| 490 | 0, // HOLE |
|---|
| 491 | 0, // HOLE |
|---|
| 492 | 0, // HOLE |
|---|
| 493 | 0, // HOLE |
|---|
| 494 | 0, // HOLE |
|---|
| 495 | 0, // HOLE |
|---|
| 496 | 0, // HOLE |
|---|
| 497 | 0, // HOLE |
|---|
| 498 | 0, // HOLE |
|---|
| 499 | 0, // HOLE |
|---|
| 500 | 0, // HOLE |
|---|
| 501 | 0, // HOLE |
|---|
| 502 | 0, // HOLE |
|---|
| 503 | 0, // HOLE |
|---|
| 504 | 0, // HOLE |
|---|
| 505 | 0, // HOLE |
|---|
| 506 | 0x00000000, // CB_BLEND0_CONTROL |
|---|
| 507 | 0x00000000, // CB_BLEND1_CONTROL |
|---|
| 508 | 0x00000000, // CB_BLEND2_CONTROL |
|---|
| 509 | 0x00000000, // CB_BLEND3_CONTROL |
|---|
| 510 | 0x00000000, // CB_BLEND4_CONTROL |
|---|
| 511 | 0x00000000, // CB_BLEND5_CONTROL |
|---|
| 512 | 0x00000000, // CB_BLEND6_CONTROL |
|---|
| 513 | 0x00000000, // CB_BLEND7_CONTROL |
|---|
| 514 | }; |
|---|
| 515 | static const u32 si_SECT_CONTEXT_def_3[] = |
|---|
| 516 | { |
|---|
| 517 | 0x00000000, // PA_CL_POINT_X_RAD |
|---|
| 518 | 0x00000000, // PA_CL_POINT_Y_RAD |
|---|
| 519 | 0x00000000, // PA_CL_POINT_SIZE |
|---|
| 520 | 0x00000000, // PA_CL_POINT_CULL_RAD |
|---|
| 521 | 0x00000000, // VGT_DMA_BASE_HI |
|---|
| 522 | 0x00000000, // VGT_DMA_BASE |
|---|
| 523 | }; |
|---|
| 524 | static const u32 si_SECT_CONTEXT_def_4[] = |
|---|
| 525 | { |
|---|
| 526 | 0x00000000, // DB_DEPTH_CONTROL |
|---|
| 527 | 0x00000000, // DB_EQAA |
|---|
| 528 | 0x00000000, // CB_COLOR_CONTROL |
|---|
| 529 | 0x00000000, // DB_SHADER_CONTROL |
|---|
| 530 | 0x00090000, // PA_CL_CLIP_CNTL |
|---|
| 531 | 0x00000004, // PA_SU_SC_MODE_CNTL |
|---|
| 532 | 0x00000000, // PA_CL_VTE_CNTL |
|---|
| 533 | 0x00000000, // PA_CL_VS_OUT_CNTL |
|---|
| 534 | 0x00000000, // PA_CL_NANINF_CNTL |
|---|
| 535 | 0x00000000, // PA_SU_LINE_STIPPLE_CNTL |
|---|
| 536 | 0x00000000, // PA_SU_LINE_STIPPLE_SCALE |
|---|
| 537 | 0x00000000, // PA_SU_PRIM_FILTER_CNTL |
|---|
| 538 | 0, // HOLE |
|---|
| 539 | 0, // HOLE |
|---|
| 540 | 0, // HOLE |
|---|
| 541 | 0, // HOLE |
|---|
| 542 | 0, // HOLE |
|---|
| 543 | 0, // HOLE |
|---|
| 544 | 0, // HOLE |
|---|
| 545 | 0, // HOLE |
|---|
| 546 | 0, // HOLE |
|---|
| 547 | 0, // HOLE |
|---|
| 548 | 0, // HOLE |
|---|
| 549 | 0, // HOLE |
|---|
| 550 | 0, // HOLE |
|---|
| 551 | 0, // HOLE |
|---|
| 552 | 0, // HOLE |
|---|
| 553 | 0, // HOLE |
|---|
| 554 | 0, // HOLE |
|---|
| 555 | 0, // HOLE |
|---|
| 556 | 0, // HOLE |
|---|
| 557 | 0, // HOLE |
|---|
| 558 | 0, // HOLE |
|---|
| 559 | 0, // HOLE |
|---|
| 560 | 0, // HOLE |
|---|
| 561 | 0, // HOLE |
|---|
| 562 | 0, // HOLE |
|---|
| 563 | 0, // HOLE |
|---|
| 564 | 0, // HOLE |
|---|
| 565 | 0, // HOLE |
|---|
| 566 | 0, // HOLE |
|---|
| 567 | 0, // HOLE |
|---|
| 568 | 0, // HOLE |
|---|
| 569 | 0, // HOLE |
|---|
| 570 | 0, // HOLE |
|---|
| 571 | 0, // HOLE |
|---|
| 572 | 0, // HOLE |
|---|
| 573 | 0, // HOLE |
|---|
| 574 | 0, // HOLE |
|---|
| 575 | 0, // HOLE |
|---|
| 576 | 0, // HOLE |
|---|
| 577 | 0, // HOLE |
|---|
| 578 | 0, // HOLE |
|---|
| 579 | 0, // HOLE |
|---|
| 580 | 0, // HOLE |
|---|
| 581 | 0, // HOLE |
|---|
| 582 | 0, // HOLE |
|---|
| 583 | 0, // HOLE |
|---|
| 584 | 0, // HOLE |
|---|
| 585 | 0, // HOLE |
|---|
| 586 | 0, // HOLE |
|---|
| 587 | 0, // HOLE |
|---|
| 588 | 0, // HOLE |
|---|
| 589 | 0, // HOLE |
|---|
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|---|
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|---|
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| 928 | static const struct cs_extent_def si_SECT_CONTEXT_defs[] = |
|---|
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| 931 | {si_SECT_CONTEXT_def_2, 0x0000a0d8, 272 }, |
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|---|
| 933 | {si_SECT_CONTEXT_def_4, 0x0000a200, 157 }, |
|---|
| 934 | {si_SECT_CONTEXT_def_5, 0x0000a2a1, 1 }, |
|---|
| 935 | {si_SECT_CONTEXT_def_6, 0x0000a2a3, 1 }, |
|---|
| 936 | {si_SECT_CONTEXT_def_7, 0x0000a2a5, 233 }, |
|---|
| 937 | { NULL, 0, 0 } |
|---|
| 938 | }; |
|---|
| 939 | static const struct cs_section_def si_cs_data[] = { |
|---|
| 940 | { si_SECT_CONTEXT_defs, SECT_CONTEXT }, |
|---|
| 941 | { NULL, SECT_NONE } |
|---|
| 942 | }; |
|---|
| 943 | |
|---|
