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| 20 | */ |
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| 21 | #ifndef _dpcs_2_0_0_OFFSET_HEADER |
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| 22 | #define |
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|---|
| 238 | #define mmDPCSTX2_DPCSTX_PLL_UPDATE_DATA 0x2add |
|---|
| 239 | #define mmDPCSTX2_DPCSTX_PLL_UPDATE_DATA_BASE_IDX 2 |
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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| 415 | #define mmRDPCSTX3_RDPCSTX_DPALT_CONTROL_REG_BASE_IDX 2 |
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| 416 | |
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| 418 | // addressBlock: dpcssys_dpcssys_cr3_dispdec |
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| 423 | #define mmDPCSSYS_CR3_DPCSSYS_CR_DATA_BASE_IDX 2 |
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| 424 | |
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| 426 | // addressBlock: dpcssys_dpcs0_dpcsrx_dispdec |
|---|
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|---|
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| 455 | #define mmDPCSTX4_DPCSTX_CBUS_CNTL_BASE_IDX 2 |
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| 469 | #define mmRDPCSTX4_RDPCSTX_CNTL_BASE_IDX 2 |
|---|
| 470 | #define mmRDPCSTX4_RDPCSTX_CLOCK_CNTL 0x2c91 |
|---|
| 471 | #define mmRDPCSTX4_RDPCSTX_CLOCK_CNTL_BASE_IDX 2 |
|---|
| 472 | #define mmRDPCSTX4_RDPCSTX_INTERRUPT_CONTROL 0x2c92 |
|---|
| 473 | #define mmRDPCSTX4_RDPCSTX_INTERRUPT_CONTROL_BASE_IDX 2 |
|---|
| 474 | #define mmRDPCSTX4_RDPCSTX_PLL_UPDATE_DATA 0x2c93 |
|---|
| 475 | #define mmRDPCSTX4_RDPCSTX_PLL_UPDATE_DATA_BASE_IDX 2 |
|---|
| 476 | #define mmRDPCSTX4_RDPCS_TX_CR_ADDR 0x2c94 |
|---|
| 477 | #define mmRDPCSTX4_RDPCS_TX_CR_ADDR_BASE_IDX 2 |
|---|
| 478 | #define mmRDPCSTX4_RDPCS_TX_CR_DATA 0x2c95 |
|---|
| 479 | #define mmRDPCSTX4_RDPCS_TX_CR_DATA_BASE_IDX 2 |
|---|
| 480 | #define mmRDPCSTX4_RDPCS_TX_SRAM_CNTL 0x2c96 |
|---|
| 481 | #define mmRDPCSTX4_RDPCS_TX_SRAM_CNTL_BASE_IDX 2 |
|---|
| 482 | #define mmRDPCSTX4_RDPCSTX_MEM_POWER_CTRL 0x2c97 |
|---|
| 483 | #define mmRDPCSTX4_RDPCSTX_MEM_POWER_CTRL_BASE_IDX 2 |
|---|
| 484 | #define mmRDPCSTX4_RDPCSTX_MEM_POWER_CTRL2 0x2c98 |
|---|
| 485 | #define mmRDPCSTX4_RDPCSTX_MEM_POWER_CTRL2_BASE_IDX 2 |
|---|
| 486 | #define mmRDPCSTX4_RDPCSTX_SCRATCH 0x2c99 |
|---|
| 487 | #define mmRDPCSTX4_RDPCSTX_SCRATCH_BASE_IDX 2 |
|---|
| 488 | #define mmRDPCSTX4_RDPCSTX_DMCU_DPALT_DIS_BLOCK_REG 0x2c9c |
|---|
| 489 | #define mmRDPCSTX4_RDPCSTX_DMCU_DPALT_DIS_BLOCK_REG_BASE_IDX 2 |
|---|
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|---|
| 491 | #define mmRDPCSTX4_RDPCSTX_DEBUG_CONFIG_BASE_IDX 2 |
|---|
| 492 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL0 0x2ca0 |
|---|
| 493 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL0_BASE_IDX 2 |
|---|
| 494 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL1 0x2ca1 |
|---|
| 495 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL1_BASE_IDX 2 |
|---|
| 496 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL2 0x2ca2 |
|---|
| 497 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL2_BASE_IDX 2 |
|---|
| 498 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL3 0x2ca3 |
|---|
| 499 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL3_BASE_IDX 2 |
|---|
| 500 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL4 0x2ca4 |
|---|
| 501 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL4_BASE_IDX 2 |
|---|
| 502 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL5 0x2ca5 |
|---|
| 503 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL5_BASE_IDX 2 |
|---|
| 504 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL6 0x2ca6 |
|---|
| 505 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL6_BASE_IDX 2 |
|---|
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|---|
| 507 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL7_BASE_IDX 2 |
|---|
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|---|
| 509 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL8_BASE_IDX 2 |
|---|
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|---|
| 511 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL9_BASE_IDX 2 |
|---|
| 512 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL10 0x2caa |
|---|
| 513 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL10_BASE_IDX 2 |
|---|
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|---|
| 515 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL11_BASE_IDX 2 |
|---|
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|---|
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|---|
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|---|
| 519 | #define mmRDPCSTX4_RDPCSTX_PHY_CNTL13_BASE_IDX 2 |
|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 527 | #define mmRDPCSTX4_RDPCSTX_PHY_FUSE2_BASE_IDX 2 |
|---|
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|---|
| 529 | #define mmRDPCSTX4_RDPCSTX_PHY_FUSE3_BASE_IDX 2 |
|---|
| 530 | #define mmRDPCSTX4_RDPCSTX_PHY_RX_LD_VAL 0x2cb3 |
|---|
| 531 | #define mmRDPCSTX4_RDPCSTX_PHY_RX_LD_VAL_BASE_IDX 2 |
|---|
| 532 | #define mmRDPCSTX4_RDPCSTX_DMCU_DPALT_PHY_CNTL3 0x2cb4 |
|---|
| 533 | #define mmRDPCSTX4_RDPCSTX_DMCU_DPALT_PHY_CNTL3_BASE_IDX 2 |
|---|
| 534 | #define mmRDPCSTX4_RDPCSTX_DMCU_DPALT_PHY_CNTL6 0x2cb5 |
|---|
| 535 | #define mmRDPCSTX4_RDPCSTX_DMCU_DPALT_PHY_CNTL6_BASE_IDX 2 |
|---|
| 536 | #define mmRDPCSTX4_RDPCSTX_DPALT_CONTROL_REG 0x2cb6 |
|---|
| 537 | #define mmRDPCSTX4_RDPCSTX_DPALT_CONTROL_REG_BASE_IDX 2 |
|---|
| 538 | |
|---|
| 539 | |
|---|
| 540 | // addressBlock: dpcssys_dpcssys_cr4_dispdec |
|---|
| 541 | // base address: 0xd80 |
|---|
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|---|
| 543 | #define mmDPCSSYS_CR4_DPCSSYS_CR_ADDR_BASE_IDX 2 |
|---|
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|---|
| 545 | #define mmDPCSSYS_CR4_DPCSSYS_CR_DATA_BASE_IDX 2 |
|---|
| 546 | |
|---|
| 547 | |
|---|
| 548 | // addressBlock: dpcssys_dpcs0_dpcstx5_dispdec |
|---|
| 549 | // base address: 0x10e0 |
|---|
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|---|
| 551 | #define mmDPCSTX5_DPCSTX_TX_CLOCK_CNTL_BASE_IDX 2 |
|---|
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|---|
| 555 | #define mmDPCSTX5_DPCSTX_CBUS_CNTL_BASE_IDX 2 |
|---|
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|---|
| 557 | #define mmDPCSTX5_DPCSTX_INTERRUPT_CNTL_BASE_IDX 2 |
|---|
| 558 | #define mmDPCSTX5_DPCSTX_PLL_UPDATE_ADDR 0x2d64 |
|---|
| 559 | #define mmDPCSTX5_DPCSTX_PLL_UPDATE_ADDR_BASE_IDX 2 |
|---|
| 560 | #define mmDPCSTX5_DPCSTX_PLL_UPDATE_DATA 0x2d65 |
|---|
| 561 | #define mmDPCSTX5_DPCSTX_PLL_UPDATE_DATA_BASE_IDX 2 |
|---|
| 562 | #define mmDPCSTX5_DPCSTX_DEBUG_CONFIG 0x2d66 |
|---|
| 563 | #define mmDPCSTX5_DPCSTX_DEBUG_CONFIG_BASE_IDX 2 |
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| 564 | |
|---|
| 565 | |
|---|
| 566 | // addressBlock: dpcssys_dpcs0_rdpcstx5_dispdec |
|---|
| 567 | // base address: 0x10e0 |
|---|
| 568 | #define mmRDPCSTX5_RDPCSTX_CNTL 0x2d68 |
|---|
| 569 | #define mmRDPCSTX5_RDPCSTX_CNTL_BASE_IDX 2 |
|---|
| 570 | #define mmRDPCSTX5_RDPCSTX_CLOCK_CNTL 0x2d69 |
|---|
| 571 | #define mmRDPCSTX5_RDPCSTX_CLOCK_CNTL_BASE_IDX 2 |
|---|
| 572 | #define mmRDPCSTX5_RDPCSTX_INTERRUPT_CONTROL 0x2d6a |
|---|
| 573 | #define mmRDPCSTX5_RDPCSTX_INTERRUPT_CONTROL_BASE_IDX 2 |
|---|
| 574 | #define mmRDPCSTX5_RDPCSTX_PLL_UPDATE_DATA 0x2d6b |
|---|
| 575 | #define mmRDPCSTX5_RDPCSTX_PLL_UPDATE_DATA_BASE_IDX 2 |
|---|
| 576 | #define mmRDPCSTX5_RDPCS_TX_CR_ADDR 0x2d6c |
|---|
| 577 | #define mmRDPCSTX5_RDPCS_TX_CR_ADDR_BASE_IDX 2 |
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| 578 | #define mmRDPCSTX5_RDPCS_TX_CR_DATA 0x2d6d |
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| 579 | #define mmRDPCSTX5_RDPCS_TX_CR_DATA_BASE_IDX 2 |
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| 580 | #define mmRDPCSTX5_RDPCS_TX_SRAM_CNTL 0x2d6e |
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| 582 | #define mmRDPCSTX5_RDPCSTX_MEM_POWER_CTRL 0x2d6f |
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| 583 | #define mmRDPCSTX5_RDPCSTX_MEM_POWER_CTRL_BASE_IDX 2 |
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| 585 | #define mmRDPCSTX5_RDPCSTX_MEM_POWER_CTRL2_BASE_IDX 2 |
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| 586 | #define mmRDPCSTX5_RDPCSTX_SCRATCH 0x2d71 |
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| 587 | #define mmRDPCSTX5_RDPCSTX_SCRATCH_BASE_IDX 2 |
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| 589 | #define mmRDPCSTX5_RDPCSTX_DMCU_DPALT_DIS_BLOCK_REG_BASE_IDX 2 |
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| 591 | #define mmRDPCSTX5_RDPCSTX_DEBUG_CONFIG_BASE_IDX 2 |
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|---|
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|---|
| 599 | #define mmRDPCSTX5_RDPCSTX_PHY_CNTL3_BASE_IDX 2 |
|---|
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|---|
| 601 | #define mmRDPCSTX5_RDPCSTX_PHY_CNTL4_BASE_IDX 2 |
|---|
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|---|
| 603 | #define mmRDPCSTX5_RDPCSTX_PHY_CNTL5_BASE_IDX 2 |
|---|
| 604 | #define mmRDPCSTX5_RDPCSTX_PHY_CNTL6 0x2d7e |
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| 605 | #define mmRDPCSTX5_RDPCSTX_PHY_CNTL6_BASE_IDX 2 |
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| 607 | #define mmRDPCSTX5_RDPCSTX_PHY_CNTL7_BASE_IDX 2 |
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| 609 | #define mmRDPCSTX5_RDPCSTX_PHY_CNTL8_BASE_IDX 2 |
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| 619 | #define mmRDPCSTX5_RDPCSTX_PHY_CNTL13_BASE_IDX 2 |
|---|
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|---|
| 621 | #define mmRDPCSTX5_RDPCSTX_PHY_CNTL14_BASE_IDX 2 |
|---|
| 622 | #define mmRDPCSTX5_RDPCSTX_PHY_FUSE0 0x2d87 |
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| 623 | #define mmRDPCSTX5_RDPCSTX_PHY_FUSE0_BASE_IDX 2 |
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| 625 | #define mmRDPCSTX5_RDPCSTX_PHY_FUSE1_BASE_IDX 2 |
|---|
| 626 | #define mmRDPCSTX5_RDPCSTX_PHY_FUSE2 0x2d89 |
|---|
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|---|
| 628 | #define mmRDPCSTX5_RDPCSTX_PHY_FUSE3 0x2d8a |
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| 629 | #define mmRDPCSTX5_RDPCSTX_PHY_FUSE3_BASE_IDX 2 |
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|---|
| 631 | #define mmRDPCSTX5_RDPCSTX_PHY_RX_LD_VAL_BASE_IDX 2 |
|---|
| 632 | #define mmRDPCSTX5_RDPCSTX_DMCU_DPALT_PHY_CNTL3 0x2d8c |
|---|
| 633 | #define mmRDPCSTX5_RDPCSTX_DMCU_DPALT_PHY_CNTL3_BASE_IDX 2 |
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| 634 | #define mmRDPCSTX5_RDPCSTX_DMCU_DPALT_PHY_CNTL6 0x2d8d |
|---|
| 635 | #define mmRDPCSTX5_RDPCSTX_DMCU_DPALT_PHY_CNTL6_BASE_IDX 2 |
|---|
| 636 | #define mmRDPCSTX5_RDPCSTX_DPALT_CONTROL_REG 0x2d8e |
|---|
| 637 | #define mmRDPCSTX5_RDPCSTX_DPALT_CONTROL_REG_BASE_IDX 2 |
|---|
| 638 | |
|---|
| 639 | |
|---|
| 640 | // addressBlock: dpcssys_dpcssys_cr5_dispdec |
|---|
| 641 | // base address: 0x10e0 |
|---|
| 642 | #define mmDPCSSYS_CR5_DPCSSYS_CR_ADDR 0x2d6c |
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| 643 | #define mmDPCSSYS_CR5_DPCSSYS_CR_ADDR_BASE_IDX 2 |
|---|
| 644 | #define mmDPCSSYS_CR5_DPCSSYS_CR_DATA 0x2d6d |
|---|
| 645 | #define mmDPCSSYS_CR5_DPCSSYS_CR_DATA_BASE_IDX 2 |
|---|
| 646 | |
|---|
| 647 | #endif |
|---|
| 648 | |
|---|
