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| 20 | */ |
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| 21 | #ifndef _gc_9_1_OFFSET_HEADER |
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| 22 | #define |
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| 23 | |
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| 30 | |
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| 1560 | #define mmVM_CONTEXT7_PAGE_TABLE_START_ADDR_HI32_BASE_IDX 0 |
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| 1562 | #define mmVM_CONTEXT8_PAGE_TABLE_START_ADDR_LO32_BASE_IDX 0 |
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| 1563 | #define mmVM_CONTEXT8_PAGE_TABLE_START_ADDR_HI32 0x091c |
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| 1564 | #define mmVM_CONTEXT8_PAGE_TABLE_START_ADDR_HI32_BASE_IDX 0 |
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| 1634 | #define mmVM_CONTEXT10_PAGE_TABLE_END_ADDR_LO32_BASE_IDX 0 |
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| 1638 | #define mmVM_CONTEXT11_PAGE_TABLE_END_ADDR_LO32_BASE_IDX 0 |
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| 1640 | #define mmVM_CONTEXT11_PAGE_TABLE_END_ADDR_HI32_BASE_IDX 0 |
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| 1650 | #define mmVM_CONTEXT14_PAGE_TABLE_END_ADDR_LO32_BASE_IDX 0 |
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| 1652 | #define mmVM_CONTEXT14_PAGE_TABLE_END_ADDR_HI32_BASE_IDX 0 |
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| 1654 | #define mmVM_CONTEXT15_PAGE_TABLE_END_ADDR_LO32_BASE_IDX 0 |
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| 1656 | #define mmVM_CONTEXT15_PAGE_TABLE_END_ADDR_HI32_BASE_IDX 0 |
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| 1657 | |
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| 1658 | |
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| 1659 | // addressBlock: gc_utcl2_vmsharedpfdec |
|---|
| 1660 | // base address: 0xa590 |
|---|
| 1661 | #define mmMC_VM_NB_MMIOBASE 0x0964 |
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| 1662 | #define mmMC_VM_NB_MMIOBASE_BASE_IDX 0 |
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| 1664 | #define mmMC_VM_NB_MMIOLIMIT_BASE_IDX 0 |
|---|
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| 1666 | #define mmMC_VM_NB_PCI_CTRL_BASE_IDX 0 |
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| 1668 | #define mmMC_VM_NB_PCI_ARB_BASE_IDX 0 |
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| 1669 | #define mmMC_VM_NB_TOP_OF_DRAM_SLOT1 0x0968 |
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| 1670 | #define mmMC_VM_NB_TOP_OF_DRAM_SLOT1_BASE_IDX 0 |
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| 1671 | #define mmMC_VM_NB_LOWER_TOP_OF_DRAM2 0x0969 |
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| 1672 | #define mmMC_VM_NB_LOWER_TOP_OF_DRAM2_BASE_IDX 0 |
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| 1673 | #define mmMC_VM_NB_UPPER_TOP_OF_DRAM2 0x096a |
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| 1674 | #define mmMC_VM_NB_UPPER_TOP_OF_DRAM2_BASE_IDX 0 |
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| 1675 | #define mmMC_VM_FB_OFFSET 0x096b |
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| 1676 | #define mmMC_VM_FB_OFFSET_BASE_IDX 0 |
|---|
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|---|
| 1678 | #define mmMC_VM_SYSTEM_APERTURE_DEFAULT_ADDR_LSB_BASE_IDX 0 |
|---|
| 1679 | #define mmMC_VM_SYSTEM_APERTURE_DEFAULT_ADDR_MSB 0x096d |
|---|
| 1680 | #define mmMC_VM_SYSTEM_APERTURE_DEFAULT_ADDR_MSB_BASE_IDX 0 |
|---|
| 1681 | #define mmMC_VM_STEERING 0x096e |
|---|
| 1682 | #define mmMC_VM_STEERING_BASE_IDX 0 |
|---|
| 1683 | #define mmMC_SHARED_VIRT_RESET_REQ 0x096f |
|---|
| 1684 | #define mmMC_SHARED_VIRT_RESET_REQ_BASE_IDX 0 |
|---|
| 1685 | #define mmMC_MEM_POWER_LS 0x0970 |
|---|
| 1686 | #define mmMC_MEM_POWER_LS_BASE_IDX 0 |
|---|
| 1687 | #define mmMC_VM_CACHEABLE_DRAM_ADDRESS_START 0x0971 |
|---|
| 1688 | #define mmMC_VM_CACHEABLE_DRAM_ADDRESS_START_BASE_IDX 0 |
|---|
| 1689 | #define mmMC_VM_CACHEABLE_DRAM_ADDRESS_END 0x0972 |
|---|
| 1690 | #define mmMC_VM_CACHEABLE_DRAM_ADDRESS_END_BASE_IDX 0 |
|---|
| 1691 | #define mmMC_VM_APT_CNTL 0x0973 |
|---|
| 1692 | #define mmMC_VM_APT_CNTL_BASE_IDX 0 |
|---|
| 1693 | #define mmMC_VM_LOCAL_HBM_ADDRESS_START 0x0974 |
|---|
| 1694 | #define mmMC_VM_LOCAL_HBM_ADDRESS_START_BASE_IDX 0 |
|---|
| 1695 | #define mmMC_VM_LOCAL_HBM_ADDRESS_END 0x0975 |
|---|
| 1696 | #define mmMC_VM_LOCAL_HBM_ADDRESS_END_BASE_IDX 0 |
|---|
| 1697 | #define mmMC_VM_LOCAL_HBM_ADDRESS_LOCK_CNTL 0x0976 |
|---|
| 1698 | #define mmMC_VM_LOCAL_HBM_ADDRESS_LOCK_CNTL_BASE_IDX 0 |
|---|
| 1699 | |
|---|
| 1700 | |
|---|
| 1701 | // addressBlock: gc_utcl2_vmsharedvcdec |
|---|
| 1702 | // base address: 0xa600 |
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| 1703 | #define mmMC_VM_FB_LOCATION_BASE 0x0980 |
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| 1704 | #define mmMC_VM_FB_LOCATION_BASE_BASE_IDX 0 |
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| 1705 | #define mmMC_VM_FB_LOCATION_TOP 0x0981 |
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| 1706 | #define mmMC_VM_FB_LOCATION_TOP_BASE_IDX 0 |
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| 1707 | #define mmMC_VM_AGP_TOP 0x0982 |
|---|
| 1708 | #define mmMC_VM_AGP_TOP_BASE_IDX 0 |
|---|
| 1709 | #define mmMC_VM_AGP_BOT 0x0983 |
|---|
| 1710 | #define mmMC_VM_AGP_BOT_BASE_IDX 0 |
|---|
| 1711 | #define mmMC_VM_AGP_BASE 0x0984 |
|---|
| 1712 | #define mmMC_VM_AGP_BASE_BASE_IDX 0 |
|---|
| 1713 | #define mmMC_VM_SYSTEM_APERTURE_LOW_ADDR 0x0985 |
|---|
| 1714 | #define mmMC_VM_SYSTEM_APERTURE_LOW_ADDR_BASE_IDX 0 |
|---|
| 1715 | #define mmMC_VM_SYSTEM_APERTURE_HIGH_ADDR 0x0986 |
|---|
| 1716 | #define mmMC_VM_SYSTEM_APERTURE_HIGH_ADDR_BASE_IDX 0 |
|---|
| 1717 | #define mmMC_VM_MX_L1_TLB_CNTL 0x0987 |
|---|
| 1718 | #define mmMC_VM_MX_L1_TLB_CNTL_BASE_IDX 0 |
|---|
| 1719 | |
|---|
| 1720 | |
|---|
| 1721 | // addressBlock: gc_ea_gceadec |
|---|
| 1722 | // base address: 0xa800 |
|---|
| 1723 | #define mmGCEA_DRAM_RD_CLI2GRP_MAP0 0x0a00 |
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| 1724 | #define mmGCEA_DRAM_RD_CLI2GRP_MAP0_BASE_IDX 0 |
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| 1725 | #define mmGCEA_DRAM_RD_CLI2GRP_MAP1 0x0a01 |
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| 1726 | #define mmGCEA_DRAM_RD_CLI2GRP_MAP1_BASE_IDX 0 |
|---|
| 1727 | #define mmGCEA_DRAM_WR_CLI2GRP_MAP0 0x0a02 |
|---|
| 1728 | #define mmGCEA_DRAM_WR_CLI2GRP_MAP0_BASE_IDX 0 |
|---|
| 1729 | #define mmGCEA_DRAM_WR_CLI2GRP_MAP1 0x0a03 |
|---|
| 1730 | #define mmGCEA_DRAM_WR_CLI2GRP_MAP1_BASE_IDX 0 |
|---|
| 1731 | #define mmGCEA_DRAM_RD_GRP2VC_MAP 0x0a04 |
|---|
| 1732 | #define mmGCEA_DRAM_RD_GRP2VC_MAP_BASE_IDX 0 |
|---|
| 1733 | #define mmGCEA_DRAM_WR_GRP2VC_MAP 0x0a05 |
|---|
| 1734 | #define mmGCEA_DRAM_WR_GRP2VC_MAP_BASE_IDX 0 |
|---|
| 1735 | #define mmGCEA_DRAM_RD_LAZY 0x0a06 |
|---|
| 1736 | #define mmGCEA_DRAM_RD_LAZY_BASE_IDX 0 |
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| 1737 | #define mmGCEA_DRAM_WR_LAZY 0x0a07 |
|---|
| 1738 | #define mmGCEA_DRAM_WR_LAZY_BASE_IDX 0 |
|---|
| 1739 | #define mmGCEA_DRAM_RD_CAM_CNTL 0x0a08 |
|---|
| 1740 | #define mmGCEA_DRAM_RD_CAM_CNTL_BASE_IDX 0 |
|---|
| 1741 | #define mmGCEA_DRAM_WR_CAM_CNTL 0x0a09 |
|---|
| 1742 | #define mmGCEA_DRAM_WR_CAM_CNTL_BASE_IDX 0 |
|---|
| 1743 | #define mmGCEA_DRAM_PAGE_BURST 0x0a0a |
|---|
| 1744 | #define mmGCEA_DRAM_PAGE_BURST_BASE_IDX 0 |
|---|
| 1745 | #define mmGCEA_DRAM_RD_PRI_AGE 0x0a0b |
|---|
| 1746 | #define mmGCEA_DRAM_RD_PRI_AGE_BASE_IDX 0 |
|---|
| 1747 | #define mmGCEA_DRAM_WR_PRI_AGE 0x0a0c |
|---|
| 1748 | #define mmGCEA_DRAM_WR_PRI_AGE_BASE_IDX 0 |
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| 1749 | #define mmGCEA_DRAM_RD_PRI_QUEUING 0x0a0d |
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| 1750 | #define mmGCEA_DRAM_RD_PRI_QUEUING_BASE_IDX 0 |
|---|
| 1751 | #define mmGCEA_DRAM_WR_PRI_QUEUING 0x0a0e |
|---|
| 1752 | #define mmGCEA_DRAM_WR_PRI_QUEUING_BASE_IDX 0 |
|---|
| 1753 | #define mmGCEA_DRAM_RD_PRI_FIXED 0x0a0f |
|---|
| 1754 | #define mmGCEA_DRAM_RD_PRI_FIXED_BASE_IDX 0 |
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| 1755 | #define mmGCEA_DRAM_WR_PRI_FIXED 0x0a10 |
|---|
| 1756 | #define mmGCEA_DRAM_WR_PRI_FIXED_BASE_IDX 0 |
|---|
| 1757 | #define mmGCEA_DRAM_RD_PRI_URGENCY 0x0a11 |
|---|
| 1758 | #define mmGCEA_DRAM_RD_PRI_URGENCY_BASE_IDX 0 |
|---|
| 1759 | #define mmGCEA_DRAM_WR_PRI_URGENCY 0x0a12 |
|---|
| 1760 | #define mmGCEA_DRAM_WR_PRI_URGENCY_BASE_IDX 0 |
|---|
| 1761 | #define mmGCEA_DRAM_RD_PRI_QUANT_PRI1 0x0a13 |
|---|
| 1762 | #define mmGCEA_DRAM_RD_PRI_QUANT_PRI1_BASE_IDX 0 |
|---|
| 1763 | #define mmGCEA_DRAM_RD_PRI_QUANT_PRI2 0x0a14 |
|---|
| 1764 | #define mmGCEA_DRAM_RD_PRI_QUANT_PRI2_BASE_IDX 0 |
|---|
| 1765 | #define mmGCEA_DRAM_RD_PRI_QUANT_PRI3 0x0a15 |
|---|
| 1766 | #define mmGCEA_DRAM_RD_PRI_QUANT_PRI3_BASE_IDX 0 |
|---|
| 1767 | #define mmGCEA_DRAM_WR_PRI_QUANT_PRI1 0x0a16 |
|---|
| 1768 | #define mmGCEA_DRAM_WR_PRI_QUANT_PRI1_BASE_IDX 0 |
|---|
| 1769 | #define mmGCEA_DRAM_WR_PRI_QUANT_PRI2 0x0a17 |
|---|
| 1770 | #define mmGCEA_DRAM_WR_PRI_QUANT_PRI2_BASE_IDX 0 |
|---|
| 1771 | #define mmGCEA_DRAM_WR_PRI_QUANT_PRI3 0x0a18 |
|---|
| 1772 | #define mmGCEA_DRAM_WR_PRI_QUANT_PRI3_BASE_IDX 0 |
|---|
| 1773 | #define mmGCEA_ADDRNORM_BASE_ADDR0 0x0a32 |
|---|
| 1774 | #define mmGCEA_ADDRNORM_BASE_ADDR0_BASE_IDX 0 |
|---|
| 1775 | #define mmGCEA_ADDRNORM_LIMIT_ADDR0 0x0a33 |
|---|
| 1776 | #define mmGCEA_ADDRNORM_LIMIT_ADDR0_BASE_IDX 0 |
|---|
| 1777 | #define mmGCEA_ADDRNORM_BASE_ADDR1 0x0a34 |
|---|
| 1778 | #define mmGCEA_ADDRNORM_BASE_ADDR1_BASE_IDX 0 |
|---|
| 1779 | #define mmGCEA_ADDRNORM_LIMIT_ADDR1 0x0a35 |
|---|
| 1780 | #define mmGCEA_ADDRNORM_LIMIT_ADDR1_BASE_IDX 0 |
|---|
| 1781 | #define mmGCEA_ADDRNORM_OFFSET_ADDR1 0x0a36 |
|---|
| 1782 | #define mmGCEA_ADDRNORM_OFFSET_ADDR1_BASE_IDX 0 |
|---|
| 1783 | #define mmGCEA_ADDRNORM_HOLE_CNTL 0x0a41 |
|---|
| 1784 | #define mmGCEA_ADDRNORM_HOLE_CNTL_BASE_IDX 0 |
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| 1785 | #define mmGCEA_ADDRDEC_BANK_CFG 0x0a42 |
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| 1870 | #define mmGCEA_ADDRDEC1_BASE_ADDR_SECCS2_BASE_IDX 0 |
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| 1884 | #define mmGCEA_ADDRDEC1_ADDR_CFG_CS23_BASE_IDX 0 |
|---|
| 1885 | #define mmGCEA_ADDRDEC1_ADDR_SEL_CS01 0x0a7e |
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| 1887 | #define mmGCEA_ADDRDEC1_ADDR_SEL_CS23 0x0a7f |
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| 1888 | #define mmGCEA_ADDRDEC1_ADDR_SEL_CS23_BASE_IDX 0 |
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| 1892 | #define mmGCEA_ADDRDEC1_COL_SEL_LO_CS23_BASE_IDX 0 |
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| 1900 | #define mmGCEA_ADDRDEC1_RM_SEL_CS23_BASE_IDX 0 |
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| 1902 | #define mmGCEA_ADDRDEC1_RM_SEL_SECCS01_BASE_IDX 0 |
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| 1903 | #define mmGCEA_ADDRDEC1_RM_SEL_SECCS23 0x0a87 |
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| 1904 | #define mmGCEA_ADDRDEC1_RM_SEL_SECCS23_BASE_IDX 0 |
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|---|
| 1910 | #define mmGCEA_IO_WR_CLI2GRP_MAP0_BASE_IDX 0 |
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| 1911 | #define mmGCEA_IO_WR_CLI2GRP_MAP1 0x0ad3 |
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| 1912 | #define mmGCEA_IO_WR_CLI2GRP_MAP1_BASE_IDX 0 |
|---|
| 1913 | #define mmGCEA_IO_RD_COMBINE_FLUSH 0x0ad4 |
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|---|
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| 1916 | #define mmGCEA_IO_WR_COMBINE_FLUSH_BASE_IDX 0 |
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| 1917 | #define mmGCEA_IO_GROUP_BURST 0x0ad6 |
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| 1918 | #define mmGCEA_IO_GROUP_BURST_BASE_IDX 0 |
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|---|
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| 1922 | #define mmGCEA_IO_WR_PRI_AGE_BASE_IDX 0 |
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|---|
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| 1930 | #define mmGCEA_IO_WR_PRI_FIXED_BASE_IDX 0 |
|---|
| 1931 | #define mmGCEA_IO_RD_PRI_URGENCY 0x0add |
|---|
| 1932 | #define mmGCEA_IO_RD_PRI_URGENCY_BASE_IDX 0 |
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| 1933 | #define mmGCEA_IO_WR_PRI_URGENCY 0x0ade |
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| 1934 | #define mmGCEA_IO_WR_PRI_URGENCY_BASE_IDX 0 |
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| 1935 | #define mmGCEA_IO_RD_PRI_URGENCY_MASK 0x0adf |
|---|
| 1936 | #define mmGCEA_IO_RD_PRI_URGENCY_MASK_BASE_IDX 0 |
|---|
| 1937 | #define mmGCEA_IO_WR_PRI_URGENCY_MASK 0x0ae0 |
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| 1938 | #define mmGCEA_IO_WR_PRI_URGENCY_MASK_BASE_IDX 0 |
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| 1939 | #define mmGCEA_IO_RD_PRI_QUANT_PRI1 0x0ae1 |
|---|
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|---|
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|---|
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| 1944 | #define mmGCEA_IO_RD_PRI_QUANT_PRI3_BASE_IDX 0 |
|---|
| 1945 | #define mmGCEA_IO_WR_PRI_QUANT_PRI1 0x0ae4 |
|---|
| 1946 | #define mmGCEA_IO_WR_PRI_QUANT_PRI1_BASE_IDX 0 |
|---|
| 1947 | #define mmGCEA_IO_WR_PRI_QUANT_PRI2 0x0ae5 |
|---|
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|---|
| 1949 | #define mmGCEA_IO_WR_PRI_QUANT_PRI3 0x0ae6 |
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| 1950 | #define mmGCEA_IO_WR_PRI_QUANT_PRI3_BASE_IDX 0 |
|---|
| 1951 | #define mmGCEA_SDP_ARB_DRAM 0x0ae7 |
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| 1952 | #define mmGCEA_SDP_ARB_DRAM_BASE_IDX 0 |
|---|
| 1953 | #define mmGCEA_SDP_ARB_FINAL 0x0ae9 |
|---|
| 1954 | #define mmGCEA_SDP_ARB_FINAL_BASE_IDX 0 |
|---|
| 1955 | #define mmGCEA_SDP_DRAM_PRIORITY 0x0aea |
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| 1956 | #define mmGCEA_SDP_DRAM_PRIORITY_BASE_IDX 0 |
|---|
| 1957 | #define mmGCEA_SDP_IO_PRIORITY 0x0aec |
|---|
| 1958 | #define mmGCEA_SDP_IO_PRIORITY_BASE_IDX 0 |
|---|
| 1959 | #define mmGCEA_SDP_CREDITS 0x0aed |
|---|
| 1960 | #define mmGCEA_SDP_CREDITS_BASE_IDX 0 |
|---|
| 1961 | #define mmGCEA_SDP_TAG_RESERVE0 0x0aee |
|---|
| 1962 | #define mmGCEA_SDP_TAG_RESERVE0_BASE_IDX 0 |
|---|
| 1963 | #define mmGCEA_SDP_TAG_RESERVE1 0x0aef |
|---|
| 1964 | #define mmGCEA_SDP_TAG_RESERVE1_BASE_IDX 0 |
|---|
| 1965 | #define mmGCEA_SDP_VCC_RESERVE0 0x0af0 |
|---|
| 1966 | #define mmGCEA_SDP_VCC_RESERVE0_BASE_IDX 0 |
|---|
| 1967 | #define mmGCEA_SDP_VCC_RESERVE1 0x0af1 |
|---|
| 1968 | #define mmGCEA_SDP_VCC_RESERVE1_BASE_IDX 0 |
|---|
| 1969 | #define mmGCEA_SDP_VCD_RESERVE0 0x0af2 |
|---|
| 1970 | #define mmGCEA_SDP_VCD_RESERVE0_BASE_IDX 0 |
|---|
| 1971 | #define mmGCEA_SDP_VCD_RESERVE1 0x0af3 |
|---|
| 1972 | #define mmGCEA_SDP_VCD_RESERVE1_BASE_IDX 0 |
|---|
| 1973 | #define mmGCEA_SDP_REQ_CNTL 0x0af4 |
|---|
| 1974 | #define mmGCEA_SDP_REQ_CNTL_BASE_IDX 0 |
|---|
| 1975 | #define mmGCEA_MISC 0x0af5 |
|---|
| 1976 | #define mmGCEA_MISC_BASE_IDX 0 |
|---|
| 1977 | #define mmGCEA_LATENCY_SAMPLING 0x0af6 |
|---|
| 1978 | #define mmGCEA_LATENCY_SAMPLING_BASE_IDX 0 |
|---|
| 1979 | #define mmGCEA_PERFCOUNTER_LO 0x0af7 |
|---|
| 1980 | #define mmGCEA_PERFCOUNTER_LO_BASE_IDX 0 |
|---|
| 1981 | #define mmGCEA_PERFCOUNTER_HI 0x0af8 |
|---|
| 1982 | #define mmGCEA_PERFCOUNTER_HI_BASE_IDX 0 |
|---|
| 1983 | #define mmGCEA_PERFCOUNTER0_CFG 0x0af9 |
|---|
| 1984 | #define mmGCEA_PERFCOUNTER0_CFG_BASE_IDX 0 |
|---|
| 1985 | #define mmGCEA_PERFCOUNTER1_CFG 0x0afa |
|---|
| 1986 | #define mmGCEA_PERFCOUNTER1_CFG_BASE_IDX 0 |
|---|
| 1987 | #define mmGCEA_PERFCOUNTER_RSLT_CNTL 0x0afb |
|---|
| 1988 | #define mmGCEA_PERFCOUNTER_RSLT_CNTL_BASE_IDX 0 |
|---|
| 1989 | |
|---|
| 1990 | |
|---|
| 1991 | // addressBlock: gc_tcdec |
|---|
| 1992 | // base address: 0xac00 |
|---|
| 1993 | #define mmTCP_INVALIDATE 0x0b00 |
|---|
| 1994 | #define mmTCP_INVALIDATE_BASE_IDX 0 |
|---|
| 1995 | #define mmTCP_STATUS 0x0b01 |
|---|
| 1996 | #define mmTCP_STATUS_BASE_IDX 0 |
|---|
| 1997 | #define mmTCP_CNTL 0x0b02 |
|---|
| 1998 | #define mmTCP_CNTL_BASE_IDX 0 |
|---|
| 1999 | #define mmTCP_CHAN_STEER_LO 0x0b03 |
|---|
| 2000 | #define mmTCP_CHAN_STEER_LO_BASE_IDX 0 |
|---|
| 2001 | #define mmTCP_CHAN_STEER_HI 0x0b04 |
|---|
| 2002 | #define mmTCP_CHAN_STEER_HI_BASE_IDX 0 |
|---|
| 2003 | #define mmTCP_ADDR_CONFIG 0x0b05 |
|---|
| 2004 | #define mmTCP_ADDR_CONFIG_BASE_IDX 0 |
|---|
| 2005 | #define mmTCP_CREDIT 0x0b06 |
|---|
| 2006 | #define mmTCP_CREDIT_BASE_IDX 0 |
|---|
| 2007 | #define mmTCP_BUFFER_ADDR_HASH_CNTL 0x0b16 |
|---|
| 2008 | #define mmTCP_BUFFER_ADDR_HASH_CNTL_BASE_IDX 0 |
|---|
| 2009 | #define mmTCP_EDC_CNT 0x0b17 |
|---|
| 2010 | #define mmTCP_EDC_CNT_BASE_IDX 0 |
|---|
| 2011 | #define mmTC_CFG_L1_LOAD_POLICY0 0x0b1a |
|---|
| 2012 | #define mmTC_CFG_L1_LOAD_POLICY0_BASE_IDX 0 |
|---|
| 2013 | #define mmTC_CFG_L1_LOAD_POLICY1 0x0b1b |
|---|
| 2014 | #define mmTC_CFG_L1_LOAD_POLICY1_BASE_IDX 0 |
|---|
| 2015 | #define mmTC_CFG_L1_STORE_POLICY 0x0b1c |
|---|
| 2016 | #define mmTC_CFG_L1_STORE_POLICY_BASE_IDX 0 |
|---|
| 2017 | #define mmTC_CFG_L2_LOAD_POLICY0 0x0b1d |
|---|
| 2018 | #define mmTC_CFG_L2_LOAD_POLICY0_BASE_IDX 0 |
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| 3763 | #define mmPA_SC_VPORT_ZMIN_4 0x00bc |
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 3866 | #define mmPA_CL_VPORT_XOFFSET_1_BASE_IDX 1 |
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|---|
| 3870 | #define mmPA_CL_VPORT_YOFFSET_1_BASE_IDX 1 |
|---|
| 3871 | #define mmPA_CL_VPORT_ZSCALE_1 0x0119 |
|---|
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|---|
| 3873 | #define mmPA_CL_VPORT_ZOFFSET_1 0x011a |
|---|
| 3874 | #define mmPA_CL_VPORT_ZOFFSET_1_BASE_IDX 1 |
|---|
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|---|
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|---|
| 3877 | #define mmPA_CL_VPORT_XOFFSET_2 0x011c |
|---|
| 3878 | #define mmPA_CL_VPORT_XOFFSET_2_BASE_IDX 1 |
|---|
| 3879 | #define mmPA_CL_VPORT_YSCALE_2 0x011d |
|---|
| 3880 | #define mmPA_CL_VPORT_YSCALE_2_BASE_IDX 1 |
|---|
| 3881 | #define mmPA_CL_VPORT_YOFFSET_2 0x011e |
|---|
| 3882 | #define mmPA_CL_VPORT_YOFFSET_2_BASE_IDX 1 |
|---|
| 3883 | #define mmPA_CL_VPORT_ZSCALE_2 0x011f |
|---|
| 3884 | #define mmPA_CL_VPORT_ZSCALE_2_BASE_IDX 1 |
|---|
| 3885 | #define mmPA_CL_VPORT_ZOFFSET_2 0x0120 |
|---|
| 3886 | #define mmPA_CL_VPORT_ZOFFSET_2_BASE_IDX 1 |
|---|
| 3887 | #define mmPA_CL_VPORT_XSCALE_3 0x0121 |
|---|
| 3888 | #define mmPA_CL_VPORT_XSCALE_3_BASE_IDX 1 |
|---|
| 3889 | #define mmPA_CL_VPORT_XOFFSET_3 0x0122 |
|---|
| 3890 | #define mmPA_CL_VPORT_XOFFSET_3_BASE_IDX 1 |
|---|
| 3891 | #define mmPA_CL_VPORT_YSCALE_3 0x0123 |
|---|
| 3892 | #define mmPA_CL_VPORT_YSCALE_3_BASE_IDX 1 |
|---|
| 3893 | #define mmPA_CL_VPORT_YOFFSET_3 0x0124 |
|---|
| 3894 | #define mmPA_CL_VPORT_YOFFSET_3_BASE_IDX 1 |
|---|
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|---|
| 3896 | #define mmPA_CL_VPORT_ZSCALE_3_BASE_IDX 1 |
|---|
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|---|
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|---|
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|---|
| 3900 | #define mmPA_CL_VPORT_XSCALE_4_BASE_IDX 1 |
|---|
| 3901 | #define mmPA_CL_VPORT_XOFFSET_4 0x0128 |
|---|
| 3902 | #define mmPA_CL_VPORT_XOFFSET_4_BASE_IDX 1 |
|---|
| 3903 | #define mmPA_CL_VPORT_YSCALE_4 0x0129 |
|---|
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|---|
| 3905 | #define mmPA_CL_VPORT_YOFFSET_4 0x012a |
|---|
| 3906 | #define mmPA_CL_VPORT_YOFFSET_4_BASE_IDX 1 |
|---|
| 3907 | #define mmPA_CL_VPORT_ZSCALE_4 0x012b |
|---|
| 3908 | #define mmPA_CL_VPORT_ZSCALE_4_BASE_IDX 1 |
|---|
| 3909 | #define mmPA_CL_VPORT_ZOFFSET_4 0x012c |
|---|
| 3910 | #define mmPA_CL_VPORT_ZOFFSET_4_BASE_IDX 1 |
|---|
| 3911 | #define mmPA_CL_VPORT_XSCALE_5 0x012d |
|---|
| 3912 | #define mmPA_CL_VPORT_XSCALE_5_BASE_IDX 1 |
|---|
| 3913 | #define mmPA_CL_VPORT_XOFFSET_5 0x012e |
|---|
| 3914 | #define mmPA_CL_VPORT_XOFFSET_5_BASE_IDX 1 |
|---|
| 3915 | #define mmPA_CL_VPORT_YSCALE_5 0x012f |
|---|
| 3916 | #define mmPA_CL_VPORT_YSCALE_5_BASE_IDX 1 |
|---|
| 3917 | #define mmPA_CL_VPORT_YOFFSET_5 0x0130 |
|---|
| 3918 | #define mmPA_CL_VPORT_YOFFSET_5_BASE_IDX 1 |
|---|
| 3919 | #define mmPA_CL_VPORT_ZSCALE_5 0x0131 |
|---|
| 3920 | #define mmPA_CL_VPORT_ZSCALE_5_BASE_IDX 1 |
|---|
| 3921 | #define mmPA_CL_VPORT_ZOFFSET_5 0x0132 |
|---|
| 3922 | #define mmPA_CL_VPORT_ZOFFSET_5_BASE_IDX 1 |
|---|
| 3923 | #define mmPA_CL_VPORT_XSCALE_6 0x0133 |
|---|
| 3924 | #define mmPA_CL_VPORT_XSCALE_6_BASE_IDX 1 |
|---|
| 3925 | #define mmPA_CL_VPORT_XOFFSET_6 0x0134 |
|---|
| 3926 | #define mmPA_CL_VPORT_XOFFSET_6_BASE_IDX 1 |
|---|
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|---|
| 3928 | #define mmPA_CL_VPORT_YSCALE_6_BASE_IDX 1 |
|---|
| 3929 | #define mmPA_CL_VPORT_YOFFSET_6 0x0136 |
|---|
| 3930 | #define mmPA_CL_VPORT_YOFFSET_6_BASE_IDX 1 |
|---|
| 3931 | #define mmPA_CL_VPORT_ZSCALE_6 0x0137 |
|---|
| 3932 | #define mmPA_CL_VPORT_ZSCALE_6_BASE_IDX 1 |
|---|
| 3933 | #define mmPA_CL_VPORT_ZOFFSET_6 0x0138 |
|---|
| 3934 | #define mmPA_CL_VPORT_ZOFFSET_6_BASE_IDX 1 |
|---|
| 3935 | #define mmPA_CL_VPORT_XSCALE_7 0x0139 |
|---|
| 3936 | #define mmPA_CL_VPORT_XSCALE_7_BASE_IDX 1 |
|---|
| 3937 | #define mmPA_CL_VPORT_XOFFSET_7 0x013a |
|---|
| 3938 | #define mmPA_CL_VPORT_XOFFSET_7_BASE_IDX 1 |
|---|
| 3939 | #define mmPA_CL_VPORT_YSCALE_7 0x013b |
|---|
| 3940 | #define mmPA_CL_VPORT_YSCALE_7_BASE_IDX 1 |
|---|
| 3941 | #define mmPA_CL_VPORT_YOFFSET_7 0x013c |
|---|
| 3942 | #define mmPA_CL_VPORT_YOFFSET_7_BASE_IDX 1 |
|---|
| 3943 | #define mmPA_CL_VPORT_ZSCALE_7 0x013d |
|---|
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|---|
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|---|
| 3948 | #define mmPA_CL_VPORT_XSCALE_8_BASE_IDX 1 |
|---|
| 3949 | #define mmPA_CL_VPORT_XOFFSET_8 0x0140 |
|---|
| 3950 | #define mmPA_CL_VPORT_XOFFSET_8_BASE_IDX 1 |
|---|
| 3951 | #define mmPA_CL_VPORT_YSCALE_8 0x0141 |
|---|
| 3952 | #define mmPA_CL_VPORT_YSCALE_8_BASE_IDX 1 |
|---|
| 3953 | #define mmPA_CL_VPORT_YOFFSET_8 0x0142 |
|---|
| 3954 | #define mmPA_CL_VPORT_YOFFSET_8_BASE_IDX 1 |
|---|
| 3955 | #define mmPA_CL_VPORT_ZSCALE_8 0x0143 |
|---|
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| 3958 | #define mmPA_CL_VPORT_ZOFFSET_8_BASE_IDX 1 |
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|---|
| 3960 | #define mmPA_CL_VPORT_XSCALE_9_BASE_IDX 1 |
|---|
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|---|
| 3962 | #define mmPA_CL_VPORT_XOFFSET_9_BASE_IDX 1 |
|---|
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|---|
| 3964 | #define mmPA_CL_VPORT_YSCALE_9_BASE_IDX 1 |
|---|
| 3965 | #define mmPA_CL_VPORT_YOFFSET_9 0x0148 |
|---|
| 3966 | #define mmPA_CL_VPORT_YOFFSET_9_BASE_IDX 1 |
|---|
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|---|
| 3968 | #define mmPA_CL_VPORT_ZSCALE_9_BASE_IDX 1 |
|---|
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|---|
| 3970 | #define mmPA_CL_VPORT_ZOFFSET_9_BASE_IDX 1 |
|---|
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|---|
| 3972 | #define mmPA_CL_VPORT_XSCALE_10_BASE_IDX 1 |
|---|
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|---|
| 3974 | #define mmPA_CL_VPORT_XOFFSET_10_BASE_IDX 1 |
|---|
| 3975 | #define mmPA_CL_VPORT_YSCALE_10 0x014d |
|---|
| 3976 | #define mmPA_CL_VPORT_YSCALE_10_BASE_IDX 1 |
|---|
| 3977 | #define mmPA_CL_VPORT_YOFFSET_10 0x014e |
|---|
| 3978 | #define mmPA_CL_VPORT_YOFFSET_10_BASE_IDX 1 |
|---|
| 3979 | #define mmPA_CL_VPORT_ZSCALE_10 0x014f |
|---|
| 3980 | #define mmPA_CL_VPORT_ZSCALE_10_BASE_IDX 1 |
|---|
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|---|
| 3982 | #define mmPA_CL_VPORT_ZOFFSET_10_BASE_IDX 1 |
|---|
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|---|
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|---|
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|---|
| 3986 | #define mmPA_CL_VPORT_XOFFSET_11_BASE_IDX 1 |
|---|
| 3987 | #define mmPA_CL_VPORT_YSCALE_11 0x0153 |
|---|
| 3988 | #define mmPA_CL_VPORT_YSCALE_11_BASE_IDX 1 |
|---|
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|---|
| 3990 | #define mmPA_CL_VPORT_YOFFSET_11_BASE_IDX 1 |
|---|
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| 3992 | #define mmPA_CL_VPORT_ZSCALE_11_BASE_IDX 1 |
|---|
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|---|
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|---|
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|---|
| 4000 | #define mmPA_CL_VPORT_YSCALE_12_BASE_IDX 1 |
|---|
| 4001 | #define mmPA_CL_VPORT_YOFFSET_12 0x015a |
|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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| 4246 | #define mmVGT_DRAW_INITIATOR_BASE_IDX 1 |
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|---|
| 4248 | #define mmVGT_IMMED_DATA_BASE_IDX 1 |
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|---|
| 4250 | #define mmVGT_EVENT_ADDRESS_REG_BASE_IDX 1 |
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| 4252 | #define mmDB_DEPTH_CONTROL_BASE_IDX 1 |
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| 4372 | #define mmVGT_VTX_CNT_EN_BASE_IDX 1 |
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|---|
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|---|
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|---|
| 4386 | #define mmVGT_STRMOUT_BUFFER_OFFSET_0_BASE_IDX 1 |
|---|
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|---|
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|---|
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|---|
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| 4396 | #define mmVGT_STRMOUT_VTX_STRIDE_2_BASE_IDX 1 |
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|---|
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|---|
| 4401 | #define mmVGT_STRMOUT_VTX_STRIDE_3 0x02c1 |
|---|
| 4402 | #define mmVGT_STRMOUT_VTX_STRIDE_3_BASE_IDX 1 |
|---|
| 4403 | #define mmVGT_STRMOUT_BUFFER_OFFSET_3 0x02c3 |
|---|
| 4404 | #define mmVGT_STRMOUT_BUFFER_OFFSET_3_BASE_IDX 1 |
|---|
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|---|
| 4408 | #define mmVGT_STRMOUT_DRAW_OPAQUE_BUFFER_FILLED_SIZE_BASE_IDX 1 |
|---|
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|---|
| 4410 | #define mmVGT_STRMOUT_DRAW_OPAQUE_VERTEX_STRIDE_BASE_IDX 1 |
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|---|
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|---|
| 4414 | #define mmVGT_TESS_DISTRIBUTION_BASE_IDX 1 |
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| 4415 | #define mmVGT_SHADER_STAGES_EN 0x02d5 |
|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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| 4430 | #define mmDB_ALPHA_TO_MASK_BASE_IDX 1 |
|---|
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|---|
| 4432 | #define mmVGT_DISPATCH_DRAW_INDEX_BASE_IDX 1 |
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|---|
| 4434 | #define mmPA_SU_POLY_OFFSET_DB_FMT_CNTL_BASE_IDX 1 |
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|---|
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|---|
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|---|
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| 4440 | #define mmPA_SU_POLY_OFFSET_FRONT_OFFSET_BASE_IDX 1 |
|---|
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|---|
| 4442 | #define mmPA_SU_POLY_OFFSET_BACK_SCALE_BASE_IDX 1 |
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| 4444 | #define mmPA_SU_POLY_OFFSET_BACK_OFFSET_BASE_IDX 1 |
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|---|
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|---|
| 4447 | #define mmVGT_STRMOUT_CONFIG 0x02e5 |
|---|
| 4448 | #define mmVGT_STRMOUT_CONFIG_BASE_IDX 1 |
|---|
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|---|
| 4450 | #define mmVGT_STRMOUT_BUFFER_CONFIG_BASE_IDX 1 |
|---|
| 4451 | #define mmVGT_DMA_EVENT_INITIATOR 0x02e7 |
|---|
| 4452 | #define mmVGT_DMA_EVENT_INITIATOR_BASE_IDX 1 |
|---|
| 4453 | #define mmPA_SC_CENTROID_PRIORITY_0 0x02f5 |
|---|
| 4454 | #define mmPA_SC_CENTROID_PRIORITY_0_BASE_IDX 1 |
|---|
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| 4456 | #define mmPA_SC_CENTROID_PRIORITY_1_BASE_IDX 1 |
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| 4457 | #define mmPA_SC_LINE_CNTL 0x02f7 |
|---|
| 4458 | #define mmPA_SC_LINE_CNTL_BASE_IDX 1 |
|---|
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|---|
| 4460 | #define mmPA_SC_AA_CONFIG_BASE_IDX 1 |
|---|
| 4461 | #define mmPA_SU_VTX_CNTL 0x02f9 |
|---|
| 4462 | #define mmPA_SU_VTX_CNTL_BASE_IDX 1 |
|---|
| 4463 | #define mmPA_CL_GB_VERT_CLIP_ADJ 0x02fa |
|---|
| 4464 | #define mmPA_CL_GB_VERT_CLIP_ADJ_BASE_IDX 1 |
|---|
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|---|
| 4466 | #define mmPA_CL_GB_VERT_DISC_ADJ_BASE_IDX 1 |
|---|
| 4467 | #define mmPA_CL_GB_HORZ_CLIP_ADJ 0x02fc |
|---|
| 4468 | #define mmPA_CL_GB_HORZ_CLIP_ADJ_BASE_IDX 1 |
|---|
| 4469 | #define mmPA_CL_GB_HORZ_DISC_ADJ 0x02fd |
|---|
| 4470 | #define mmPA_CL_GB_HORZ_DISC_ADJ_BASE_IDX 1 |
|---|
| 4471 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y0_0 0x02fe |
|---|
| 4472 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y0_0_BASE_IDX 1 |
|---|
| 4473 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y0_1 0x02ff |
|---|
| 4474 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y0_1_BASE_IDX 1 |
|---|
| 4475 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y0_2 0x0300 |
|---|
| 4476 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y0_2_BASE_IDX 1 |
|---|
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|---|
| 4478 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y0_3_BASE_IDX 1 |
|---|
| 4479 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X1Y0_0 0x0302 |
|---|
| 4480 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X1Y0_0_BASE_IDX 1 |
|---|
| 4481 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X1Y0_1 0x0303 |
|---|
| 4482 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X1Y0_1_BASE_IDX 1 |
|---|
| 4483 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X1Y0_2 0x0304 |
|---|
| 4484 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X1Y0_2_BASE_IDX 1 |
|---|
| 4485 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X1Y0_3 0x0305 |
|---|
| 4486 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X1Y0_3_BASE_IDX 1 |
|---|
| 4487 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y1_0 0x0306 |
|---|
| 4488 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y1_0_BASE_IDX 1 |
|---|
| 4489 | #define mmPA_SC_AA_SAMPLE_LOCS_PIXEL_X0Y1_1 0x0307 |
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|---|
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|---|
| 5170 | #define mmVGT_NUM_INSTANCES_BASE_IDX 1 |
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|---|
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| 5188 | #define mmWD_INDEX_BUF_BASE_BASE_IDX 1 |
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|---|
| 5190 | #define mmWD_INDEX_BUF_BASE_HI_BASE_IDX 1 |
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|---|
| 5192 | #define mmIA_MULTI_VGT_PARAM_BASE_IDX 1 |
|---|
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|---|
| 5194 | #define mmVGT_INSTANCE_BASE_ID_BASE_IDX 1 |
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|---|
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|---|
| 5198 | #define mmPA_SC_LINE_STIPPLE_STATE_BASE_IDX 1 |
|---|
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|---|
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|---|
| 5202 | #define mmPA_SC_SCREEN_EXTENT_MAX_0_BASE_IDX 1 |
|---|
| 5203 | #define mmPA_SC_SCREEN_EXTENT_MIN_1 0x2286 |
|---|
| 5204 | #define mmPA_SC_SCREEN_EXTENT_MIN_1_BASE_IDX 1 |
|---|
| 5205 | #define mmPA_SC_SCREEN_EXTENT_MAX_1 0x228b |
|---|
| 5206 | #define mmPA_SC_SCREEN_EXTENT_MAX_1_BASE_IDX 1 |
|---|
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|---|
| 5208 | #define mmPA_SC_P3D_TRAP_SCREEN_HV_EN_BASE_IDX 1 |
|---|
| 5209 | #define mmPA_SC_P3D_TRAP_SCREEN_H 0x22a1 |
|---|
| 5210 | #define mmPA_SC_P3D_TRAP_SCREEN_H_BASE_IDX 1 |
|---|
| 5211 | #define mmPA_SC_P3D_TRAP_SCREEN_V 0x22a2 |
|---|
| 5212 | #define mmPA_SC_P3D_TRAP_SCREEN_V_BASE_IDX 1 |
|---|
| 5213 | #define mmPA_SC_P3D_TRAP_SCREEN_OCCURRENCE 0x22a3 |
|---|
| 5214 | #define mmPA_SC_P3D_TRAP_SCREEN_OCCURRENCE_BASE_IDX 1 |
|---|
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|---|
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|---|
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|---|
| 5218 | #define mmPA_SC_HP3D_TRAP_SCREEN_HV_EN_BASE_IDX 1 |
|---|
| 5219 | #define mmPA_SC_HP3D_TRAP_SCREEN_H 0x22a9 |
|---|
| 5220 | #define mmPA_SC_HP3D_TRAP_SCREEN_H_BASE_IDX 1 |
|---|
| 5221 | #define mmPA_SC_HP3D_TRAP_SCREEN_V 0x22aa |
|---|
| 5222 | #define mmPA_SC_HP3D_TRAP_SCREEN_V_BASE_IDX 1 |
|---|
| 5223 | #define mmPA_SC_HP3D_TRAP_SCREEN_OCCURRENCE 0x22ab |
|---|
| 5224 | #define mmPA_SC_HP3D_TRAP_SCREEN_OCCURRENCE_BASE_IDX 1 |
|---|
| 5225 | #define mmPA_SC_HP3D_TRAP_SCREEN_COUNT 0x22ac |
|---|
| 5226 | #define mmPA_SC_HP3D_TRAP_SCREEN_COUNT_BASE_IDX 1 |
|---|
| 5227 | #define mmPA_SC_TRAP_SCREEN_HV_EN 0x22b0 |
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|---|
| 5230 | #define mmPA_SC_TRAP_SCREEN_H_BASE_IDX 1 |
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| 5232 | #define mmPA_SC_TRAP_SCREEN_V_BASE_IDX 1 |
|---|
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|---|
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|---|
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| 6151 | // addressBlock: gc_utcl2_atcl2pfcntldec |
|---|
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|---|
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|---|
| 6161 | // addressBlock: gc_utcl2_vml2pldec |
|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 6180 | #define mmMC_VM_L2_PERFCOUNTER_RSLT_CNTL_BASE_IDX 1 |
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|---|
| 6183 | // addressBlock: gc_rlcpdec |
|---|
| 6184 | // base address: 0x3b000 |
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 6192 | #define mmRLC_MEM_SLP_CNTL_BASE_IDX 1 |
|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 6202 | #define mmRLC_REFCLOCK_TIMESTAMP_LSB_BASE_IDX 1 |
|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 6210 | #define mmRLC_GPM_TIMER_INT_2_BASE_IDX 1 |
|---|
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|---|
| 6212 | #define mmRLC_GPM_TIMER_CTRL_BASE_IDX 1 |
|---|
| 6213 | #define mmRLC_LB_CNTR_MAX 0x4c12 |
|---|
| 6214 | #define mmRLC_LB_CNTR_MAX_BASE_IDX 1 |
|---|
| 6215 | #define mmRLC_GPM_TIMER_STAT 0x4c13 |
|---|
| 6216 | #define mmRLC_GPM_TIMER_STAT_BASE_IDX 1 |
|---|
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|---|
| 6218 | #define mmRLC_GPM_TIMER_INT_3_BASE_IDX 1 |
|---|
| 6219 | #define mmRLC_SERDES_WR_NONCU_MASTER_MASK_1 0x4c16 |
|---|
| 6220 | #define mmRLC_SERDES_WR_NONCU_MASTER_MASK_1_BASE_IDX 1 |
|---|
| 6221 | #define mmRLC_SERDES_NONCU_MASTER_BUSY_1 0x4c17 |
|---|
| 6222 | #define mmRLC_SERDES_NONCU_MASTER_BUSY_1_BASE_IDX 1 |
|---|
| 6223 | #define mmRLC_INT_STAT 0x4c18 |
|---|
| 6224 | #define mmRLC_INT_STAT_BASE_IDX 1 |
|---|
| 6225 | #define mmRLC_LB_CNTL 0x4c19 |
|---|
| 6226 | #define mmRLC_LB_CNTL_BASE_IDX 1 |
|---|
| 6227 | #define mmRLC_MGCG_CTRL 0x4c1a |
|---|
| 6228 | #define mmRLC_MGCG_CTRL_BASE_IDX 1 |
|---|
| 6229 | #define mmRLC_LB_CNTR_INIT 0x4c1b |
|---|
| 6230 | #define mmRLC_LB_CNTR_INIT_BASE_IDX 1 |
|---|
| 6231 | #define mmRLC_LOAD_BALANCE_CNTR 0x4c1c |
|---|
| 6232 | #define mmRLC_LOAD_BALANCE_CNTR_BASE_IDX 1 |
|---|
| 6233 | #define mmRLC_JUMP_TABLE_RESTORE 0x4c1e |
|---|
| 6234 | #define mmRLC_JUMP_TABLE_RESTORE_BASE_IDX 1 |
|---|
| 6235 | #define mmRLC_PG_DELAY_2 0x4c1f |
|---|
| 6236 | #define mmRLC_PG_DELAY_2_BASE_IDX 1 |
|---|
| 6237 | #define mmRLC_GPU_CLOCK_COUNT_LSB 0x4c24 |
|---|
| 6238 | #define mmRLC_GPU_CLOCK_COUNT_LSB_BASE_IDX 1 |
|---|
| 6239 | #define mmRLC_GPU_CLOCK_COUNT_MSB 0x4c25 |
|---|
| 6240 | #define mmRLC_GPU_CLOCK_COUNT_MSB_BASE_IDX 1 |
|---|
| 6241 | #define mmRLC_CAPTURE_GPU_CLOCK_COUNT 0x4c26 |
|---|
| 6242 | #define mmRLC_CAPTURE_GPU_CLOCK_COUNT_BASE_IDX 1 |
|---|
| 6243 | #define mmRLC_UCODE_CNTL 0x4c27 |
|---|
| 6244 | #define mmRLC_UCODE_CNTL_BASE_IDX 1 |
|---|
| 6245 | #define mmRLC_GPM_THREAD_RESET 0x4c28 |
|---|
| 6246 | #define mmRLC_GPM_THREAD_RESET_BASE_IDX 1 |
|---|
| 6247 | #define mmRLC_GPM_CP_DMA_COMPLETE_T0 0x4c29 |
|---|
| 6248 | #define mmRLC_GPM_CP_DMA_COMPLETE_T0_BASE_IDX 1 |
|---|
| 6249 | #define mmRLC_GPM_CP_DMA_COMPLETE_T1 0x4c2a |
|---|
| 6250 | #define mmRLC_GPM_CP_DMA_COMPLETE_T1_BASE_IDX 1 |
|---|
| 6251 | #define mmRLC_FIREWALL_VIOLATION 0x4c2b |
|---|
| 6252 | #define mmRLC_FIREWALL_VIOLATION_BASE_IDX 1 |
|---|
| 6253 | #define mmRLC_GPM_STAT 0x4c40 |
|---|
| 6254 | #define mmRLC_GPM_STAT_BASE_IDX 1 |
|---|
| 6255 | #define mmRLC_GPU_CLOCK_32_RES_SEL 0x4c41 |
|---|
| 6256 | #define mmRLC_GPU_CLOCK_32_RES_SEL_BASE_IDX 1 |
|---|
| 6257 | #define mmRLC_GPU_CLOCK_32 0x4c42 |
|---|
| 6258 | #define mmRLC_GPU_CLOCK_32_BASE_IDX 1 |
|---|
| 6259 | #define mmRLC_PG_CNTL 0x4c43 |
|---|
| 6260 | #define mmRLC_PG_CNTL_BASE_IDX 1 |
|---|
| 6261 | #define mmRLC_GPM_THREAD_PRIORITY 0x4c44 |
|---|
| 6262 | #define mmRLC_GPM_THREAD_PRIORITY_BASE_IDX 1 |
|---|
| 6263 | #define mmRLC_GPM_THREAD_ENABLE 0x4c45 |
|---|
| 6264 | #define mmRLC_GPM_THREAD_ENABLE_BASE_IDX 1 |
|---|
| 6265 | #define mmRLC_CGTT_MGCG_OVERRIDE 0x4c48 |
|---|
| 6266 | #define mmRLC_CGTT_MGCG_OVERRIDE_BASE_IDX 1 |
|---|
| 6267 | #define mmRLC_CGCG_CGLS_CTRL 0x4c49 |
|---|
| 6268 | #define mmRLC_CGCG_CGLS_CTRL_BASE_IDX 1 |
|---|
| 6269 | #define mmRLC_CGCG_RAMP_CTRL 0x4c4a |
|---|
| 6270 | #define mmRLC_CGCG_RAMP_CTRL_BASE_IDX 1 |
|---|
| 6271 | #define mmRLC_DYN_PG_STATUS 0x4c4b |
|---|
| 6272 | #define mmRLC_DYN_PG_STATUS_BASE_IDX 1 |
|---|
| 6273 | #define mmRLC_DYN_PG_REQUEST 0x4c4c |
|---|
| 6274 | #define mmRLC_DYN_PG_REQUEST_BASE_IDX 1 |
|---|
| 6275 | #define mmRLC_PG_DELAY 0x4c4d |
|---|
| 6276 | #define mmRLC_PG_DELAY_BASE_IDX 1 |
|---|
| 6277 | #define mmRLC_CU_STATUS 0x4c4e |
|---|
| 6278 | #define mmRLC_CU_STATUS_BASE_IDX 1 |
|---|
| 6279 | #define mmRLC_LB_INIT_CU_MASK 0x4c4f |
|---|
| 6280 | #define mmRLC_LB_INIT_CU_MASK_BASE_IDX 1 |
|---|
| 6281 | #define mmRLC_LB_ALWAYS_ACTIVE_CU_MASK 0x4c50 |
|---|
| 6282 | #define mmRLC_LB_ALWAYS_ACTIVE_CU_MASK_BASE_IDX 1 |
|---|
| 6283 | #define mmRLC_LB_PARAMS 0x4c51 |
|---|
| 6284 | #define mmRLC_LB_PARAMS_BASE_IDX 1 |
|---|
| 6285 | #define mmRLC_THREAD1_DELAY 0x4c52 |
|---|
| 6286 | #define mmRLC_THREAD1_DELAY_BASE_IDX 1 |
|---|
| 6287 | #define mmRLC_PG_ALWAYS_ON_CU_MASK 0x4c53 |
|---|
| 6288 | #define mmRLC_PG_ALWAYS_ON_CU_MASK_BASE_IDX 1 |
|---|
| 6289 | #define mmRLC_MAX_PG_CU 0x4c54 |
|---|
| 6290 | #define mmRLC_MAX_PG_CU_BASE_IDX 1 |
|---|
| 6291 | #define mmRLC_AUTO_PG_CTRL 0x4c55 |
|---|
| 6292 | #define mmRLC_AUTO_PG_CTRL_BASE_IDX 1 |
|---|
| 6293 | #define mmRLC_SMU_GRBM_REG_SAVE_CTRL 0x4c56 |
|---|
| 6294 | #define mmRLC_SMU_GRBM_REG_SAVE_CTRL_BASE_IDX 1 |
|---|
| 6295 | #define mmRLC_SERDES_RD_MASTER_INDEX 0x4c59 |
|---|
| 6296 | #define mmRLC_SERDES_RD_MASTER_INDEX_BASE_IDX 1 |
|---|
| 6297 | #define mmRLC_SERDES_RD_DATA_0 0x4c5a |
|---|
| 6298 | #define mmRLC_SERDES_RD_DATA_0_BASE_IDX 1 |
|---|
| 6299 | #define mmRLC_SERDES_RD_DATA_1 0x4c5b |
|---|
| 6300 | #define mmRLC_SERDES_RD_DATA_1_BASE_IDX 1 |
|---|
| 6301 | #define mmRLC_SERDES_RD_DATA_2 0x4c5c |
|---|
| 6302 | #define mmRLC_SERDES_RD_DATA_2_BASE_IDX 1 |
|---|
| 6303 | #define mmRLC_SERDES_WR_CU_MASTER_MASK 0x4c5d |
|---|
| 6304 | #define mmRLC_SERDES_WR_CU_MASTER_MASK_BASE_IDX 1 |
|---|
| 6305 | #define mmRLC_SERDES_WR_NONCU_MASTER_MASK 0x4c5e |
|---|
| 6306 | #define mmRLC_SERDES_WR_NONCU_MASTER_MASK_BASE_IDX 1 |
|---|
| 6307 | #define mmRLC_SERDES_WR_CTRL 0x4c5f |
|---|
| 6308 | #define mmRLC_SERDES_WR_CTRL_BASE_IDX 1 |
|---|
| 6309 | #define mmRLC_SERDES_WR_DATA 0x4c60 |
|---|
| 6310 | #define mmRLC_SERDES_WR_DATA_BASE_IDX 1 |
|---|
| 6311 | #define mmRLC_SERDES_CU_MASTER_BUSY 0x4c61 |
|---|
| 6312 | #define mmRLC_SERDES_CU_MASTER_BUSY_BASE_IDX 1 |
|---|
| 6313 | #define mmRLC_SERDES_NONCU_MASTER_BUSY 0x4c62 |
|---|
| 6314 | #define mmRLC_SERDES_NONCU_MASTER_BUSY_BASE_IDX 1 |
|---|
| 6315 | #define mmRLC_GPM_GENERAL_0 0x4c63 |
|---|
| 6316 | #define mmRLC_GPM_GENERAL_0_BASE_IDX 1 |
|---|
| 6317 | #define mmRLC_GPM_GENERAL_1 0x4c64 |
|---|
| 6318 | #define mmRLC_GPM_GENERAL_1_BASE_IDX 1 |
|---|
| 6319 | #define mmRLC_GPM_GENERAL_2 0x4c65 |
|---|
| 6320 | #define mmRLC_GPM_GENERAL_2_BASE_IDX 1 |
|---|
| 6321 | #define mmRLC_GPM_GENERAL_3 0x4c66 |
|---|
| 6322 | #define mmRLC_GPM_GENERAL_3_BASE_IDX 1 |
|---|
| 6323 | #define mmRLC_GPM_GENERAL_4 0x4c67 |
|---|
| 6324 | #define mmRLC_GPM_GENERAL_4_BASE_IDX 1 |
|---|
| 6325 | #define mmRLC_GPM_GENERAL_5 0x4c68 |
|---|
| 6326 | #define mmRLC_GPM_GENERAL_5_BASE_IDX 1 |
|---|
| 6327 | #define mmRLC_GPM_GENERAL_6 0x4c69 |
|---|
| 6328 | #define mmRLC_GPM_GENERAL_6_BASE_IDX 1 |
|---|
| 6329 | #define mmRLC_GPM_GENERAL_7 0x4c6a |
|---|
| 6330 | #define mmRLC_GPM_GENERAL_7_BASE_IDX 1 |
|---|
| 6331 | #define mmRLC_GPM_SCRATCH_ADDR 0x4c6c |
|---|
| 6332 | #define mmRLC_GPM_SCRATCH_ADDR_BASE_IDX 1 |
|---|
| 6333 | #define mmRLC_GPM_SCRATCH_DATA 0x4c6d |
|---|
| 6334 | #define mmRLC_GPM_SCRATCH_DATA_BASE_IDX 1 |
|---|
| 6335 | #define mmRLC_STATIC_PG_STATUS 0x4c6e |
|---|
| 6336 | #define mmRLC_STATIC_PG_STATUS_BASE_IDX 1 |
|---|
| 6337 | #define mmRLC_SPM_MC_CNTL 0x4c71 |
|---|
| 6338 | #define mmRLC_SPM_MC_CNTL_BASE_IDX 1 |
|---|
| 6339 | #define mmRLC_SPM_INT_CNTL 0x4c72 |
|---|
| 6340 | #define mmRLC_SPM_INT_CNTL_BASE_IDX 1 |
|---|
| 6341 | #define mmRLC_SPM_INT_STATUS 0x4c73 |
|---|
| 6342 | #define mmRLC_SPM_INT_STATUS_BASE_IDX 1 |
|---|
| 6343 | #define mmRLC_SMU_MESSAGE 0x4c76 |
|---|
| 6344 | #define mmRLC_SMU_MESSAGE_BASE_IDX 1 |
|---|
| 6345 | #define mmRLC_GPM_LOG_SIZE 0x4c77 |
|---|
| 6346 | #define mmRLC_GPM_LOG_SIZE_BASE_IDX 1 |
|---|
| 6347 | #define mmRLC_PG_DELAY_3 0x4c78 |
|---|
| 6348 | #define mmRLC_PG_DELAY_3_BASE_IDX 1 |
|---|
| 6349 | #define mmRLC_GPR_REG1 0x4c79 |
|---|
| 6350 | #define mmRLC_GPR_REG1_BASE_IDX 1 |
|---|
| 6351 | #define mmRLC_GPR_REG2 0x4c7a |
|---|
| 6352 | #define mmRLC_GPR_REG2_BASE_IDX 1 |
|---|
| 6353 | #define mmRLC_GPM_LOG_CONT 0x4c7b |
|---|
| 6354 | #define mmRLC_GPM_LOG_CONT_BASE_IDX 1 |
|---|
| 6355 | #define mmRLC_GPM_INT_DISABLE_TH0 0x4c7c |
|---|
| 6356 | #define mmRLC_GPM_INT_DISABLE_TH0_BASE_IDX 1 |
|---|
| 6357 | #define mmRLC_GPM_INT_DISABLE_TH1 0x4c7d |
|---|
| 6358 | #define mmRLC_GPM_INT_DISABLE_TH1_BASE_IDX 1 |
|---|
| 6359 | #define mmRLC_GPM_INT_FORCE_TH0 0x4c7e |
|---|
| 6360 | #define mmRLC_GPM_INT_FORCE_TH0_BASE_IDX 1 |
|---|
| 6361 | #define mmRLC_GPM_INT_FORCE_TH1 0x4c7f |
|---|
| 6362 | #define mmRLC_GPM_INT_FORCE_TH1_BASE_IDX 1 |
|---|
| 6363 | #define mmRLC_SRM_CNTL 0x4c80 |
|---|
| 6364 | #define mmRLC_SRM_CNTL_BASE_IDX 1 |
|---|
| 6365 | #define mmRLC_SRM_ARAM_ADDR 0x4c83 |
|---|
| 6366 | #define mmRLC_SRM_ARAM_ADDR_BASE_IDX 1 |
|---|
| 6367 | #define mmRLC_SRM_ARAM_DATA 0x4c84 |
|---|
| 6368 | #define mmRLC_SRM_ARAM_DATA_BASE_IDX 1 |
|---|
| 6369 | #define mmRLC_SRM_DRAM_ADDR 0x4c85 |
|---|
| 6370 | #define mmRLC_SRM_DRAM_ADDR_BASE_IDX 1 |
|---|
| 6371 | #define mmRLC_SRM_DRAM_DATA 0x4c86 |
|---|
| 6372 | #define mmRLC_SRM_DRAM_DATA_BASE_IDX 1 |
|---|
| 6373 | #define mmRLC_SRM_GPM_COMMAND 0x4c87 |
|---|
| 6374 | #define mmRLC_SRM_GPM_COMMAND_BASE_IDX 1 |
|---|
| 6375 | #define mmRLC_SRM_GPM_COMMAND_STATUS 0x4c88 |
|---|
| 6376 | #define mmRLC_SRM_GPM_COMMAND_STATUS_BASE_IDX 1 |
|---|
| 6377 | #define mmRLC_SRM_RLCV_COMMAND 0x4c89 |
|---|
| 6378 | #define mmRLC_SRM_RLCV_COMMAND_BASE_IDX 1 |
|---|
| 6379 | #define mmRLC_SRM_RLCV_COMMAND_STATUS 0x4c8a |
|---|
| 6380 | #define mmRLC_SRM_RLCV_COMMAND_STATUS_BASE_IDX 1 |
|---|
| 6381 | #define mmRLC_SRM_INDEX_CNTL_ADDR_0 0x4c8b |
|---|
| 6382 | #define mmRLC_SRM_INDEX_CNTL_ADDR_0_BASE_IDX 1 |
|---|
| 6383 | #define mmRLC_SRM_INDEX_CNTL_ADDR_1 0x4c8c |
|---|
| 6384 | #define mmRLC_SRM_INDEX_CNTL_ADDR_1_BASE_IDX 1 |
|---|
| 6385 | #define mmRLC_SRM_INDEX_CNTL_ADDR_2 0x4c8d |
|---|
| 6386 | #define mmRLC_SRM_INDEX_CNTL_ADDR_2_BASE_IDX 1 |
|---|
| 6387 | #define mmRLC_SRM_INDEX_CNTL_ADDR_3 0x4c8e |
|---|
| 6388 | #define mmRLC_SRM_INDEX_CNTL_ADDR_3_BASE_IDX 1 |
|---|
| 6389 | #define mmRLC_SRM_INDEX_CNTL_ADDR_4 0x4c8f |
|---|
| 6390 | #define mmRLC_SRM_INDEX_CNTL_ADDR_4_BASE_IDX 1 |
|---|
| 6391 | #define mmRLC_SRM_INDEX_CNTL_ADDR_5 0x4c90 |
|---|
| 6392 | #define mmRLC_SRM_INDEX_CNTL_ADDR_5_BASE_IDX 1 |
|---|
| 6393 | #define mmRLC_SRM_INDEX_CNTL_ADDR_6 0x4c91 |
|---|
| 6394 | #define mmRLC_SRM_INDEX_CNTL_ADDR_6_BASE_IDX 1 |
|---|
| 6395 | #define mmRLC_SRM_INDEX_CNTL_ADDR_7 0x4c92 |
|---|
| 6396 | #define mmRLC_SRM_INDEX_CNTL_ADDR_7_BASE_IDX 1 |
|---|
| 6397 | #define mmRLC_SRM_INDEX_CNTL_DATA_0 0x4c93 |
|---|
| 6398 | #define mmRLC_SRM_INDEX_CNTL_DATA_0_BASE_IDX 1 |
|---|
| 6399 | #define mmRLC_SRM_INDEX_CNTL_DATA_1 0x4c94 |
|---|
| 6400 | #define mmRLC_SRM_INDEX_CNTL_DATA_1_BASE_IDX 1 |
|---|
| 6401 | #define mmRLC_SRM_INDEX_CNTL_DATA_2 0x4c95 |
|---|
| 6402 | #define mmRLC_SRM_INDEX_CNTL_DATA_2_BASE_IDX 1 |
|---|
| 6403 | #define mmRLC_SRM_INDEX_CNTL_DATA_3 0x4c96 |
|---|
| 6404 | #define mmRLC_SRM_INDEX_CNTL_DATA_3_BASE_IDX 1 |
|---|
| 6405 | #define mmRLC_SRM_INDEX_CNTL_DATA_4 0x4c97 |
|---|
| 6406 | #define mmRLC_SRM_INDEX_CNTL_DATA_4_BASE_IDX 1 |
|---|
| 6407 | #define mmRLC_SRM_INDEX_CNTL_DATA_5 0x4c98 |
|---|
| 6408 | #define mmRLC_SRM_INDEX_CNTL_DATA_5_BASE_IDX 1 |
|---|
| 6409 | #define mmRLC_SRM_INDEX_CNTL_DATA_6 0x4c99 |
|---|
| 6410 | #define mmRLC_SRM_INDEX_CNTL_DATA_6_BASE_IDX 1 |
|---|
| 6411 | #define mmRLC_SRM_INDEX_CNTL_DATA_7 0x4c9a |
|---|
| 6412 | #define mmRLC_SRM_INDEX_CNTL_DATA_7_BASE_IDX 1 |
|---|
| 6413 | #define mmRLC_SRM_STAT 0x4c9b |
|---|
| 6414 | #define mmRLC_SRM_STAT_BASE_IDX 1 |
|---|
| 6415 | #define mmRLC_SRM_GPM_ABORT 0x4c9c |
|---|
| 6416 | #define mmRLC_SRM_GPM_ABORT_BASE_IDX 1 |
|---|
| 6417 | #define mmRLC_CSIB_ADDR_LO 0x4ca2 |
|---|
| 6418 | #define mmRLC_CSIB_ADDR_LO_BASE_IDX 1 |
|---|
| 6419 | #define mmRLC_CSIB_ADDR_HI 0x4ca3 |
|---|
| 6420 | #define mmRLC_CSIB_ADDR_HI_BASE_IDX 1 |
|---|
| 6421 | #define mmRLC_CSIB_LENGTH 0x4ca4 |
|---|
| 6422 | #define mmRLC_CSIB_LENGTH_BASE_IDX 1 |
|---|
| 6423 | #define mmRLC_SMU_COMMAND 0x4ca9 |
|---|
| 6424 | #define mmRLC_SMU_COMMAND_BASE_IDX 1 |
|---|
| 6425 | #define mmRLC_CP_SCHEDULERS 0x4caa |
|---|
| 6426 | #define mmRLC_CP_SCHEDULERS_BASE_IDX 1 |
|---|
| 6427 | #define mmRLC_SMU_ARGUMENT_1 0x4cab |
|---|
| 6428 | #define mmRLC_SMU_ARGUMENT_1_BASE_IDX 1 |
|---|
| 6429 | #define mmRLC_SMU_ARGUMENT_2 0x4cac |
|---|
| 6430 | #define mmRLC_SMU_ARGUMENT_2_BASE_IDX 1 |
|---|
| 6431 | #define mmRLC_GPM_GENERAL_8 0x4cad |
|---|
| 6432 | #define mmRLC_GPM_GENERAL_8_BASE_IDX 1 |
|---|
| 6433 | #define mmRLC_GPM_GENERAL_9 0x4cae |
|---|
| 6434 | #define mmRLC_GPM_GENERAL_9_BASE_IDX 1 |
|---|
| 6435 | #define mmRLC_GPM_GENERAL_10 0x4caf |
|---|
| 6436 | #define mmRLC_GPM_GENERAL_10_BASE_IDX 1 |
|---|
| 6437 | #define mmRLC_GPM_GENERAL_11 0x4cb0 |
|---|
| 6438 | #define mmRLC_GPM_GENERAL_11_BASE_IDX 1 |
|---|
| 6439 | #define mmRLC_GPM_GENERAL_12 0x4cb1 |
|---|
| 6440 | #define mmRLC_GPM_GENERAL_12_BASE_IDX 1 |
|---|
| 6441 | #define mmRLC_GPM_UTCL1_CNTL_0 0x4cb2 |
|---|
| 6442 | #define mmRLC_GPM_UTCL1_CNTL_0_BASE_IDX 1 |
|---|
| 6443 | #define mmRLC_GPM_UTCL1_CNTL_1 0x4cb3 |
|---|
| 6444 | #define mmRLC_GPM_UTCL1_CNTL_1_BASE_IDX 1 |
|---|
| 6445 | #define mmRLC_GPM_UTCL1_CNTL_2 0x4cb4 |
|---|
| 6446 | #define mmRLC_GPM_UTCL1_CNTL_2_BASE_IDX 1 |
|---|
| 6447 | #define mmRLC_SPM_UTCL1_CNTL 0x4cb5 |
|---|
| 6448 | #define mmRLC_SPM_UTCL1_CNTL_BASE_IDX 1 |
|---|
| 6449 | #define mmRLC_UTCL1_STATUS_2 0x4cb6 |
|---|
| 6450 | #define mmRLC_UTCL1_STATUS_2_BASE_IDX 1 |
|---|
| 6451 | #define mmRLC_LB_THR_CONFIG_2 0x4cb8 |
|---|
| 6452 | #define mmRLC_LB_THR_CONFIG_2_BASE_IDX 1 |
|---|
| 6453 | #define mmRLC_LB_THR_CONFIG_3 0x4cb9 |
|---|
| 6454 | #define mmRLC_LB_THR_CONFIG_3_BASE_IDX 1 |
|---|
| 6455 | #define mmRLC_LB_THR_CONFIG_4 0x4cba |
|---|
| 6456 | #define mmRLC_LB_THR_CONFIG_4_BASE_IDX 1 |
|---|
| 6457 | #define mmRLC_SPM_UTCL1_ERROR_1 0x4cbc |
|---|
| 6458 | #define mmRLC_SPM_UTCL1_ERROR_1_BASE_IDX 1 |
|---|
| 6459 | #define mmRLC_SPM_UTCL1_ERROR_2 0x4cbd |
|---|
| 6460 | #define mmRLC_SPM_UTCL1_ERROR_2_BASE_IDX 1 |
|---|
| 6461 | #define mmRLC_GPM_UTCL1_TH0_ERROR_1 0x4cbe |
|---|
| 6462 | #define mmRLC_GPM_UTCL1_TH0_ERROR_1_BASE_IDX 1 |
|---|
| 6463 | #define mmRLC_LB_THR_CONFIG_1 0x4cbf |
|---|
| 6464 | #define mmRLC_LB_THR_CONFIG_1_BASE_IDX 1 |
|---|
| 6465 | #define mmRLC_GPM_UTCL1_TH0_ERROR_2 0x4cc0 |
|---|
| 6466 | #define mmRLC_GPM_UTCL1_TH0_ERROR_2_BASE_IDX 1 |
|---|
| 6467 | #define mmRLC_GPM_UTCL1_TH1_ERROR_1 0x4cc1 |
|---|
| 6468 | #define mmRLC_GPM_UTCL1_TH1_ERROR_1_BASE_IDX 1 |
|---|
| 6469 | #define mmRLC_GPM_UTCL1_TH1_ERROR_2 0x4cc2 |
|---|
| 6470 | #define mmRLC_GPM_UTCL1_TH1_ERROR_2_BASE_IDX 1 |
|---|
| 6471 | #define mmRLC_GPM_UTCL1_TH2_ERROR_1 0x4cc3 |
|---|
| 6472 | #define mmRLC_GPM_UTCL1_TH2_ERROR_1_BASE_IDX 1 |
|---|
| 6473 | #define mmRLC_GPM_UTCL1_TH2_ERROR_2 0x4cc4 |
|---|
| 6474 | #define mmRLC_GPM_UTCL1_TH2_ERROR_2_BASE_IDX 1 |
|---|
| 6475 | #define mmRLC_CGCG_CGLS_CTRL_3D 0x4cc5 |
|---|
| 6476 | #define mmRLC_CGCG_CGLS_CTRL_3D_BASE_IDX 1 |
|---|
| 6477 | #define mmRLC_CGCG_RAMP_CTRL_3D 0x4cc6 |
|---|
| 6478 | #define mmRLC_CGCG_RAMP_CTRL_3D_BASE_IDX 1 |
|---|
| 6479 | #define mmRLC_SEMAPHORE_0 0x4cc7 |
|---|
| 6480 | #define mmRLC_SEMAPHORE_0_BASE_IDX 1 |
|---|
| 6481 | #define mmRLC_SEMAPHORE_1 0x4cc8 |
|---|
| 6482 | #define mmRLC_SEMAPHORE_1_BASE_IDX 1 |
|---|
| 6483 | #define mmRLC_CP_EOF_INT 0x4cca |
|---|
| 6484 | #define mmRLC_CP_EOF_INT_BASE_IDX 1 |
|---|
| 6485 | #define mmRLC_CP_EOF_INT_CNT 0x4ccb |
|---|
| 6486 | #define mmRLC_CP_EOF_INT_CNT_BASE_IDX 1 |
|---|
| 6487 | #define mmRLC_SPARE_INT 0x4ccc |
|---|
| 6488 | #define mmRLC_SPARE_INT_BASE_IDX 1 |
|---|
| 6489 | #define mmRLC_PREWALKER_UTCL1_CNTL 0x4ccd |
|---|
| 6490 | #define mmRLC_PREWALKER_UTCL1_CNTL_BASE_IDX 1 |
|---|
| 6491 | #define mmRLC_PREWALKER_UTCL1_TRIG 0x4cce |
|---|
| 6492 | #define mmRLC_PREWALKER_UTCL1_TRIG_BASE_IDX 1 |
|---|
| 6493 | #define mmRLC_PREWALKER_UTCL1_ADDR_LSB 0x4ccf |
|---|
| 6494 | #define mmRLC_PREWALKER_UTCL1_ADDR_LSB_BASE_IDX 1 |
|---|
| 6495 | #define mmRLC_PREWALKER_UTCL1_ADDR_MSB 0x4cd0 |
|---|
| 6496 | #define mmRLC_PREWALKER_UTCL1_ADDR_MSB_BASE_IDX 1 |
|---|
| 6497 | #define mmRLC_PREWALKER_UTCL1_SIZE_LSB 0x4cd1 |
|---|
| 6498 | #define mmRLC_PREWALKER_UTCL1_SIZE_LSB_BASE_IDX 1 |
|---|
| 6499 | #define mmRLC_PREWALKER_UTCL1_SIZE_MSB 0x4cd2 |
|---|
| 6500 | #define mmRLC_PREWALKER_UTCL1_SIZE_MSB_BASE_IDX 1 |
|---|
| 6501 | #define mmRLC_DSM_TRIG 0x4cd3 |
|---|
| 6502 | #define mmRLC_DSM_TRIG_BASE_IDX 1 |
|---|
| 6503 | #define mmRLC_UTCL1_STATUS 0x4cd4 |
|---|
| 6504 | #define mmRLC_UTCL1_STATUS_BASE_IDX 1 |
|---|
| 6505 | #define mmRLC_R2I_CNTL_0 0x4cd5 |
|---|
| 6506 | #define mmRLC_R2I_CNTL_0_BASE_IDX 1 |
|---|
| 6507 | #define mmRLC_R2I_CNTL_1 0x4cd6 |
|---|
| 6508 | #define mmRLC_R2I_CNTL_1_BASE_IDX 1 |
|---|
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| 6740 | #define mmCGTT_PA_CLK_CTRL_BASE_IDX 1 |
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 6810 | |
|---|
| 6811 | // addressBlock: gc_utcl2_vmsharedhvdec |
|---|
| 6812 | // base address: 0x3ea00 |
|---|
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| 6814 | #define mmMC_VM_FB_SIZE_OFFSET_VF0_BASE_IDX 1 |
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| 6844 | #define mmMC_VM_FB_SIZE_OFFSET_VF15_BASE_IDX 1 |
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| 6846 | #define mmVM_IOMMU_MMIO_CNTRL_1_BASE_IDX 1 |
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|---|
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|---|
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| 6881 | #define mmMC_VM_MARC_LEN_LO_1 0x5aa2 |
|---|
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|---|
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|---|
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|---|
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|---|
| 6898 | #define mmVM_IOMMU_PERFORMANCE_OPTIMIZATION_CONTROL_REGISTER_BASE_IDX 1 |
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|---|
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|---|
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|---|
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|---|
| 6907 | #define mmVM_PCIE_ATS_CNTL_VF_3 0x5aaf |
|---|
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|---|
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|---|
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|---|
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|---|
| 6912 | #define mmVM_PCIE_ATS_CNTL_VF_5_BASE_IDX 1 |
|---|
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|---|
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|---|
| 6918 | #define mmVM_PCIE_ATS_CNTL_VF_8_BASE_IDX 1 |
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| 6922 | #define mmVM_PCIE_ATS_CNTL_VF_10_BASE_IDX 1 |
|---|
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| 6924 | #define mmVM_PCIE_ATS_CNTL_VF_11_BASE_IDX 1 |
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| 6926 | #define mmVM_PCIE_ATS_CNTL_VF_12_BASE_IDX 1 |
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|---|
| 6928 | #define mmVM_PCIE_ATS_CNTL_VF_13_BASE_IDX 1 |
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| 6932 | #define mmVM_PCIE_ATS_CNTL_VF_15_BASE_IDX 1 |
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|---|
| 6934 | #define mmUTCL2_CGTT_CLK_CTRL_BASE_IDX 1 |
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|---|
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| 6937 | // addressBlock: gc_hypdec |
|---|
| 6938 | // base address: 0x3e000 |
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| 6940 | #define mmCP_HYP_PFP_UCODE_ADDR_BASE_IDX 1 |
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| 6941 | #define mmCP_PFP_UCODE_ADDR 0x5814 |
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| 6942 | #define mmCP_PFP_UCODE_ADDR_BASE_IDX 1 |
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| 6944 | #define mmCP_HYP_PFP_UCODE_DATA_BASE_IDX 1 |
|---|
| 6945 | #define mmCP_PFP_UCODE_DATA 0x5815 |
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| 6948 | #define mmCP_HYP_ME_UCODE_ADDR_BASE_IDX 1 |
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|---|
| 6950 | #define mmCP_ME_RAM_RADDR_BASE_IDX 1 |
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| 6952 | #define mmCP_ME_RAM_WADDR_BASE_IDX 1 |
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| 6954 | #define mmCP_HYP_ME_UCODE_DATA_BASE_IDX 1 |
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| 6958 | #define mmCP_CE_UCODE_ADDR_BASE_IDX 1 |
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| 6960 | #define mmCP_HYP_CE_UCODE_ADDR_BASE_IDX 1 |
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| 6982 | #define mmRLC_GPM_UCODE_ADDR_BASE_IDX 1 |
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